使边界扫描与功能测试相结合实现最大功率的功能测试装置设计

作者： IPSES， XJTAG

生产后的中度复杂的印刷电路板（PCB）传统上使用在线测试（ICT）和功能测试来进行检测。其它的测试方法，例如昂贵的光学和X光检查，经常是必须的，以来验证BGA被正确地放置。然而，JTAG边界扫描可以取代ICT，以作为功能测试的自然配对物，并且使光学与X光检查不再必要。

ICT是一个隔离测试每个部件或者连接的方法。其使用例如用于简单模拟部件的保护技术等技术。通过针床或者飞针对被测设备表面节点的访问，被用来验证与这些节点相连的已安装的部件的正确性。

图1.使用保护技术测量电阻

尽管这类测试验证了每个单一部件的正确性，它却不能够验证一个板卡，当通电时，是否能作为一个整体正常运行。想要做到这点就必须进行功能测试。

尽管新测试方法在繁衍，功能测试依然是认定电子系统和板卡正常运行的支柱。从概念上来讲，这类测试非常简单-它在于检测一个被测单元是否真正做到它所被设计的那样。一个针床装置也被融合进来以提供测试访问。这个测试方法的中心单独来讲是有些局限的，因为我们只能确认每个系统运行正常，而不是被隔离的单独部件

图2，一个典型的功能测试装置

或许一个例子最能揭示ICT与功能测试的区别。考虑一个串联接口的MAX202驱动（见图3）。ICT可能与检查充电泵里电容的值有关，从而确认每个部件在隔离下运转正常，而功能测试则可能会检查发送和接收整个数据包。

图3.MAX232驱动典型的连接图

直到最近，ICT才允许在执行功能测试之前，容易地验证所有部件的正确安装。然而，近来可达到部件密度的增长意味着PCB设计会经常不允许布置足够数量的测试点。尤其是BGA部件的针脚在被焊接下后，完全不能被ICT访问。其结果是ICT性价比越来越差，越来越不可持续，并且增加产品交货期。这个问题最有革新的方案是边界扫描。

JTAG边界扫描

JTAG边界扫描是一个电子测试方法，被设计用来克服通常与复杂的、高密度板卡所相关的测试访问问题。边界扫描，按照IEEE 1149.x标准，提供了芯片中一个可以使综合数字测试协议在板卡层面就可适用的的电子线路。

这个线路把用在ICT中的物理探点用边界扫描单元来替代。它们存在于器件核心逻辑与外部针脚之间，可以在芯片上每个输入与输出处捕获或者驱入信号。

边界扫描单元可以在一个物理探头不能达到的地方提供虚拟探点，例如BGA下的焊点连接。一些细间距引线器件不能用物理探头可靠地检测，不过边界扫描再一次可以为这些针脚提供数字测试访问。

在器件的正常运作下，边界扫描单元如透明一般。它们可以捕获通过它们的数值，使可以观测数据流，而不改变通过它们的信号成为可能。当一序列正确的指令 被送到控制针脚（测试模式选择，TMS）上时，边界扫描单元还可以通过与它们相连的针脚驱动出数值，像一个物理探点或者探针一样激发电路。这允许工程师们， 用之前ICT测试同样的方式，来验证所有部件适当的互连（轨迹间短路的缺乏与连续性的验证），以及这些器件的正确行为。

图4.边界扫描部件的简化图

边界扫描单元形成了一个串联的扫描路径，称为边界扫描寄存器。一序列需要写入的数值可以通过TDI针脚被同步入这个寄存器中，而且一旦数据被边界扫描单元捕获，它可以通过TDO针脚被同步出去。JTAG器件可以被连接起来形成一个JTAG链。链中一个器件上的TDO针脚与另一个器件上的TDI针脚相连形成一个单一的寄存器。控制和时钟信号（TMS和TCK）为链中的每个器件所共有。

正因为如此，ICT可以在一定程度上或者完全被侵入性更小的边界扫描测试所取代，使用边界扫描单元来代替物理探针。每个JTAG链都需要一个适当的测试访问端口（TAP），包含四个针脚（TDI，TDO，TMS与TCK，以及一个可选的第五个TRST针脚）在一个外部连接器上。这与一个JTAG控制器相连，通常是一个伴有边界扫描软件套装的小型USB硬件。

虽然JTAG边界扫描被发现可以提高整体测试访问，因而覆盖率，但是它是一个数字协议，所以并不能直接测试模拟部分。边界扫描访问仅限于带有至少一个JTAG器件的网（及与之相连的部件）。许多主导的JTAG边界扫描系统含有“可测试设计”工具。它可以在设计阶段显示一个板卡的测试覆盖率，突出显示板卡上没有足够JTAG访问的区域。在这个阶段，或许可以将一个不支持JTAG的器件用一个支持的替换，以增加测试覆盖率。

新方法：使边界扫描与功能测试相结合

想要全面地测试一个系统，边界扫描测试必须与功能测试一起运行。边界扫描与ICT一样，只能验证每个部件放置正确以及运行正常。它不会验证整个电路像设计的一样工作。

当把ICT与功能测试（生产结束时最常见的）相结合时，工程师几乎总会发现它们在两个不同的工作台上测试。因为对于每个JTAG链只需要一个单一连接器上的4个针脚，把边界扫描融入到一个功能测试装置上非常容易，并且能节约宝贵的时间与精力。事实上一些电子测试专家已经开始开发可以把功能和边界扫描集成到一个工作台的装置和测试台，以提供具有竞争力的总体成本以及开发时间的、更完全的设备。

图5（左）已将被测设备插入的集成功能测试与边界扫描测试装置

图6（右）装置内部，功能测试设备与边界扫描测试接口相集成的地方。

最大效率

集合功能与边界扫描测试于一个系统带来大量的和重要的好处。两个方法相互补充，在于弥补每个技术可能的缺陷，以带来更高的可靠性与有效性。两个一起使用可能创造其它方式不可能取得的、良好的测试条件。

例如，通过用于功能测试的探针的激发，可能生成能被边界扫描链所验证的模式，然后可以激活电路中可以被功能测试所验证的部分。集成方法的有效性意味着您不仅可以从一个设备中运行两种测试类型，还意味着这些测试为板卡的设计与生产提供了更大的把握。

这些益处可以从一个测试直接与FPGA相连的DAC的简单例子中看到。使用边界扫描可以恰当地驱动FPGA的I/O来为DAC的模拟输出编程，从而可以通过功能测试被捕获板测量到。另一方面，如果我们考虑一个与FPGA直接相交互的ADC，在功能测试中可以使用一个生成卡来激活前者，然后使用边界扫描来检测被ADC读数所编译的位元。

以上的集成方法允许工程师们达到：

被测设备（模拟与数字）上和所有网的所有电路全部或者接近全部的覆盖率

更短的测试时间-除了边界扫描与功能测试序列被并行执行的事实，考虑在测试台上装载与卸载被测试设备的时间也是必须。很明显它在使用两个工作台的时候是双倍的

高性能在线烧录

更快，更准确的故障诊断

目前有可用的强大的工具来允许您拥有交互的硬件以及执行测试序列的开发环境，以用于集成测试系统的开发。只要简单地把PXI JTAG模块装进PXI架里，它就能允许与边界扫描链的交互。它可以和适用于具体应用的功能测试的几个硬件装备在一起。

尽管边界扫描测试序列的开发应该用专业的工具（一个JTAG开发环境）来进行，生成的序列不仅可以与为功能测试所开发的序列相关联，您还可以共同管理序列中提供两类测试交互的部分。这样，一旦功能和边界扫描序列开发完成，并且集成一起， *** 作员接口将会被独特地定制。

通过选择一个可以允许不同类型硬件容易的结合模块测试系统，包括第三方所开发的，您就有一个可以轻松升级与配置的、集成功能和边界扫描测试的单一工作台，不仅可以提供测试的可靠性，而且减少他们的成本与时间。

什么是边界扫描？

硅设计方面的进步，例如增加器件密度和最近的BGA封装，使传统测试方法的功效大打折扣。为了克服这些问题，一些世界领先的硅生产商联合起来成立了联合测试小组。

这个小组的研究发现和建议被用来作为IEEE 1149.1标准，即标准测试访问端口和边界扫描结构的基础。这个标准保留了和这个小组的联系并且以缩写JTAG被大家所俗知。

JTAG边界扫描是一项被设计用来克服通常与复杂的、高密度的板相关联之类的测试访问问题的测试技术。通过激发位于例如FPGA与CPLD部件上的边界扫描单元，工程师们可以用一个JTAG控制器对电路进行数码地测试，并且使用强大的软件套装来精确地找到故障的位置与原因。

因为不再需要测试点，与ITC和功能测试相关的物理访问问题不再是一个问题。测试系统与边界扫描单元只通过一个4-5线测试总线相连。这必须在板卡设计中被考虑进来以确保可测性。许多领先的JTAG边界扫描系统销售商提供可测性设计指南来鼓励设计工程师们去这样做。

它是如何工作的？

所有器件核心逻辑与针脚间的信号都被一个称为边界扫描寄存器（Boundary Scan Register --- BSR）的串联扫描路径所截获。在正常工作模式下，边界扫描单元是隐形的，而在测试模式下，这些单元可以被用来设置和/或读取数值。在边界扫描过程中，一系列4-5个不同的信号被用来回报电路的性能。

责任编辑：gt