计算机组成原理

计算机组成原理

三、名词解释

1计算机系统：由硬件和软件两大部分组成，有多种层次结构。

2主机：CPU、存储器和输入输出接口合起来构成计算机的主机。

3主存：用于存放正在访问的信息

4辅存：用于存放暂时不用的信息。

5高速缓存：用于存放正在访问信息的付本。

6中央处理器：是计算机的核心部件，由运算器和控制器构成。

7硬件：是指计算机实体部分，它由看得见摸得着的各种电子元器件，各类光、电、机设备的实物组成。

软件：指看不见摸不着，由人们事先编制的具有各类特殊功能的程序组成。

8系统软件：又称系统程序，主要用来管理整个计算机系统，监视服务，使系统资源得到合理调度，高效运行。

应用软件：又称应用程序，它是用户根据任务需要所编制的各种程序。

9源程序：通常由用户用各种编程语言编写的程序。

目的程序：由计算机将其翻译机器能识别的机器语言程序。

10总线：是连接多个部件的信息传输线，是各部件共享的传输介质。

11系统总线：是指CPU、主存、I/O设备（通过I/O接口）各大部件之间的信息传输线。

通信总线：是指用于计算机系统之间或者计算机系统与其他系统（如控制仪表、移动通信）之间的通信的线路。

按传送方式分并行和串行。串行通信是指数据在单条1位宽的传输线上，一位一位的按顺序分时传送。并行通信是指数据在多条并行1位宽的传输线上，同时由源传送到目的地。

12带宽：单位时间内可以传送的最大的信息量。

13机器字长：是指CPU一次并行处理数据的位数，通常与CPU的寄存器位数有关。

14主存容量：是指主存中存放二进制代码的总位数。

15机器数：符号位数字化，0代表正数，1代表负数。

16定点数：小数点固定在某一位位置的数。

17浮点数：小数点的位置可以浮动的数。

18补码：带符号数据表示方法之一，正数的反码和原码相同，负数的反码是将二进制按位取反后在最低位再加1

19溢出：在计算机中，超出机器字长，发生错误的结果。

20非编码键盘：采用软件判断键是否按下及设键、译键、计算键值的方法的键盘。

21A/D转换器：它能将模拟量转换成数字量，是计算机的输入设备。

22I/O接口：指主机与I/O设备之间设置的一个硬件电路及器相应的软件控制。

23端口：指接口电路中的一些寄存器，用来存放数据信息、控制信息和状态信息。

24中断：计算机在执行程序的过程中，当出现异常情况或特殊请求时，计算机停止现行程序的运行转向对这些异常情况或特殊请求处理，处理结束后再返回到现行程序的间断处，继续执行源程序。

25中断源：凡能向CPU提出中断请求的各种因素统称为中断源。

26中断嵌套：计算机在处理中断的过程中，有可能出现新的中断请求，此时CPU暂停现行中断服务程序，转向新的中断请求，这种现象称为中断嵌套。

27优先级：为使系统能及时响应并处理发生的所有中断，系统根据引起中断事件的重要性和紧迫程度，硬件将中断源分为若干个级别。

28DMA方式：用硬件在主存与外设之间直接进行数据传送，不须CPU，用软件控制。

29指令系统：将全部机器指令的集合称为机器的指令系统。

30寻址方式：是指确定本条指令的数据地址以及下一条将要执行的指令地址的方法，它与硬件结构紧密相关，而且直接影响指令格式和指令功能。

31指令周期：完成一条指令的时间，由若干机器周期组成。

机器周期：完成摸个独立 *** 作，由若干时钟周期组成。

时钟周期：最基本时间单位，由主频决定。

32微 *** 作：在微程序控制器中，执行部件接受微指令后所进行的最基本的 *** 作。

33微指令：控制器存储的控制代码，分为 *** 作控制部分和顺序控制部分，由微命令组成。

34微程序：存储在控制存储器中的完成指令功能的程序，由微指令组成。

35控制存储器：CPU内用于存放实现指令系统全部指令的微程序的只读存储器。

二、计算

314 设总线的时钟频率为8MHZ，一个总线周期等于一个时钟周期。如果一个总线周期中并行传送16位数据，试问总线的带宽是多少？

解：由于：f=8MHz,T=1/f=1/8M秒，因为一个总线周期等于一个时钟周期

所以：总线带宽=16/（1/8M） = 128Mbps=16MBps

315 在一个32位的总线系统中，总线的时钟频率为66MHZ，假设总线最短传输周期为4个时钟周期，试计算总线的最大数据传输率。若想提高数据传输率，可采取什么措施？

解：总线传输周期=41/66M秒

总线的最大数据传输率=32/(4/66M)=528Mbps=66MBps

若想提高数据传输率，可以提高总线时钟频率、增大总线宽度或者减少总线传输周期包含的时钟周期个数。

316 在异步串行传送系统中，字符格式为：1个起始位、8个数据位、1个校验位、2个终止位。若要求每秒传送120个字符，试求传送的波特率和比特率。

解：一帧包含：1+8+1+2=12位

故波特率为：（1+8+1+2）120=1440bps

比特率为：8120=960bps

45 什么是存储器的带宽？若存储器的数据总线宽度为32位，存取周期为200ns，则存储器的带宽是多少？

解：存储器的带宽指单位时间内从存储器进出信息的最大数量。

存储器带宽 = 1/200ns ×32位 = 160M位/秒 = 20MB/秒（注：1ns=10-9s）

47 一个容量为16K×32位的存储器，其地址线和数据线的总和是多少？当选用下列不同规格的存储芯片时，各需要多少片？

1K×4位，2K×8位，4K×4位，16K×1位，4K×8位，8K×8位

解：地址线和数据线的总和 = 14 + 32 = 46根；

选择不同的芯片时，各需要的片数为：

1K×4：（16K×32） / （1K×4） = 16×8 = 128片

2K×8：（16K×32） / （2K×8） = 8×4 = 32片

4K×4：（16K×32） / （4K×4） = 4×8 = 32片

16K×1：（16K×32）/ （16K×1） = 1×32 = 32片

4K×8：（16K×32）/ （4K×8） = 4×4 = 16片

8K×8：（16K×32） / （8K×8） = 2×4 = 8片

64 设机器数字长为8位（含1位符号位在内），写出对应下列各真值的原码、补码和反码。 -13/64，-87

解：真值与不同机器码对应关系如下：

真值 -13/64 -87

原码 1001 1010 1，101 0111

补码 11100110 1，0101001

反码 11100101 1，0101000

65 已知[x]补，求[x]原和x。

[x1]补=11100; [x2]补=11001; [x4]补=10000;

[x5]补=1,0101; [x6]补=1,1100; [x8]补=1,0000;

解：[x]补与[x]原、x的对应关系如下：

真值 -1/4 -7/16 -1 -11 -4 -16

[x]补 11100 11001 10000 1,0101 1,1100 1,0000

[x]原 10100 10111 无 1,1011 1,0100 无

x -00100 -00111 -10000 -1011 -0100 -10000

69 当十六进制数9B和FF分别表示为原码、补码、反码、移码和无符号数时，所对应的十进制数各为多少（设机器数采用一位符号位）？

解：真值和机器数的对应关系如下：

原码 补码 移码 无符号数

9BH -27 -101 +27 155

原码 补码 移码 无符号数

FFH -128 -1 +128 256

612 设浮点数格式为：阶码5位（含1位阶符），尾数11位（含1位数符）。写出-27/1024、-865所对应的机器数。要求如下：

（1）阶码和尾数均为原码。

（2）阶码和尾数均为补码。

（3）阶码为移码，尾数为补码。

解：据题意画出该浮点数的格式：

阶符1位 阶码4位 数符1位 尾数10位

将十进制数转换为二进制: x1= -27/1024= -00000011011B = 2-5(-011011B）

x3=-865=-10101101B=27(-010101101B)

则以上各数的浮点规格化数为：

（1）[x1]原=1，0101；1110 110 000 0

[x3]原=0，0111；1101 011 010 0

（2）[x1]补=1，1011；1001 010 000 0

[x3]补=0，0111；1010 100 110 0

（3）[x1]移补=0，1011；1001 010 000 0

[x3]移补=1，0111；1010 100 110 0

619 设机器数字长为8位（含1位符号位），用补码运算规则计算下列各题。

（2）A=19/32，B=-17/128，求A-B。

（4）A=-87，B=53，求A-B。

解：（2）A=19/32= 0100 1100B, B= -17/128= -0001 0001B

[A]补=00100 1100, [B]补=11110 1111 , [-B]补=00001 0001

[A-B]补=[A]补+[-B]补

=001001100 + 000010001

=001011101 ——无溢出

A-B= 0101 1101B = 93/128B

（4）A= -87= -101 0111B, B=53=110 101B

[A]补=11, 010 1001, [B]补=00, 011 0101, [-B]补=11, 100 1011

[A-B]补=[A]补+[-B]补

= 11,0101001 + 11,1001011

= 10,1110100 —— 溢出

621 用原码加减交替法和补码加减交替法计算x÷y。

（2）x=-010101， y=011011；

（4）x=13/32， y= -27/32。

（2）[x]原=110101 x=010101 [X]补=101011 XfYf=1

010101

+100101

111010 0

110100

+011011

001111 0

011110

+100101

000011 011

000110

+100101

101011 0110

010110

+011011

110001 01100

100010

+011011

111101 011000

[y]原=011011 y=011011 [Y]补=011011 [-y]补=100101

[x/y]原=111000

（4）做法相同，打表格太累，仅给出结果。[x/y]原=101111

三、应用

414 某8位微型机地址码为18位，若使用4K×4位的RAM芯片组成模块板结构的存储器，试问：

（1）该机所允许的最大主存空间是多少？

（2）若每个模块板为32K×8位，共需几个模块板？

（3）每个模块板内共有几片RAM芯片？

（4）共有多少片RAM？

（5）CPU如何选择各模块板？

解：（1）该机所允许的最大主存空间是：218 × 8位 = 256K×8位 = 256KB

（2）模块板总数 = 256K×8 / 32K×8 = 8块

（3）板内片数 = 32K×8位 / 4K×4位 = 8×2 = 16片

（4）总片数 = 16片×8 = 128片

（5）CPU通过最高3位地址译码输出选择模板，次高3位地址译码输出选择芯片。地址格式分配如下：

429 假设CPU执行某段程序时共访问Cache命中4800次，访问主存200次，已知Cache的存取周期为30ns，主存的存取周期为150ns，求Cache的命中率以及Cache-主存系统的平均访问时间和效率，试问该系统的性能提高了多少倍？

解：Cache被访问命中率为：4800/(4800+200)=24/25=96%

则Cache-主存系统的平均访问时间为：ta=09630ns+(1-096)150ns=348ns

Cache-主存系统的访问效率为：e=tc/ta100%=30/348100%=862%

性能为原来的150ns/348ns=431倍，即提高了331倍。

例72设相对寻址的转移指令占3个字节，第一字节为 *** 作码，第二，三字节为相对位移量（补码表示）。而且数据在存储器中采用以低字节地址为字地址的存放方式。每当CPU从存储器取出一个字节时，即自动完成（PC）+1 PC。

（1） 若PC当前值为240（十进制），要求转移到290（十进制），则转移指令的第二、三字节的机器代码是什么？

（2） 若PC当前值为240（十进制），要求转移到200（十进制），则转移指令的第二、三字节的机器代码是什么？

解:（1）PC当前值为240，该指令取出后PC值为243，要求转移到290，即相对位移量为290-243=47，转换成补码为2FH。由于数据在存储器中采用以低字节地址为字地址的存放方式，故该转移指令的第二字节为2FH，第三字节为00H。

（2）PC当前值为240，该指令取出后PC值为243，要求转移到200，即相对位移量为200-243=-43，转换成补码为D5H。由于数据在存储器中采用以低字节地址为字地址的存放方式，故该转移指令的第二字节为D5H，第三字节为FFH。

例73一条双字长直接寻址的子程序调用指令，其第一个字为 *** 作码喝寻址特征，第二个字为地址码5000H。假设PC当前值为2000H，SP的内容为0100H，栈顶内容为2746H，存储器按字节编址，而且进栈 *** 作时执行（SP）-△-P，后存入数据。试回答下列几种情况下，PC、SP及栈顶内容各为多少？

（1） CALL指令被读取前。

（2） CALL指令被执行后。

（3） 子程序返回后。

解CALL指令被读取前，PC=2000H，SP=0100H，栈顶内容为2746H。

（1） CALL指令被执行后，犹豫存储器按字节编制，CALL指令供占4个字节，故程序断电2004H进栈，此时SP=（SP）-2=00FEH，栈顶内容为2004H，PC被更新为子程序入口地址5000H。

（2） 子程序返回后，程序断点出栈，PC=2004H，SP被修改为0100H，栈顶内容为2746H。

76某指令系统字长为16位，地址码取4位，试提出一种方案，使该地址系统有8条三地址指令、16条二地址指令、100条一地址指令。

解：

OP A2 A1 A0 三地址指令8条

0000

•

•

•

0111

OP A1 A0 二地址指令16条

10000000

•

•

•

10001111

OP A0 一地址指令100条

110000000000

110001100011

77设指令字长为16位，采用扩展 *** 作码技术，每个 *** 作码的地址为6位。如果定义了13条二地址指令，试问还可安排多少条一地址指令。

解：（24-3）26=364=192条

78某机指令字长16位，每个 *** 作数的地址码为6位，设 *** 作码长度固定，指令分为零地址，一地址和二地址三种格式，若零地址指令有M种，以抵制指令有N种，则二地址指令最多有几种？若 *** 作码位数可变，则二地址指令最多允许有几种？

解：1）若采用定长 *** 作码时，二地址指令格式如下：

OP（4位） A1（6位） A2（6位）

设二地址指令有K种，则：K=24-M-N

当M=1（最小值），N=1（最小值）时，二地址指令最多有：Kmax=16-1-1=14种

2）若采用变长 *** 作码时，二地址指令格式仍如1）所示，但 *** 作码长度可随地址码的个数而变。此时，K= 24 -（N/26 + M/212 ）；

当（N/26 + M/212 ）1时（N/26 + M/212 向上取整），K最大，则二地址指令最多有：

Kmax=16-1=15种（只留一种编码作扩展标志用。）

95设机器A的CPU主频为8MHz，机器周期为4个时钟周期，且该机的平均指令执行速度是04MIPS，试求该机的平均指令周期和机器周期，每个指令周期中含几个机器周期？如果机器B的CPU主频为12MHz，且机器周期也含有4个时钟周期，试问B机的平均指令执行速度为多少MIPS

ACLK=8MHz T=1/8MHz=0125us

机器周期=4T=05us

因为执行速度为04MIPS 所以平均指令周期=1/04MIPS=25us

25us/05us=5个 所以每个指令含有5条机器指令

BT=1/f=1/12MHz=1/12us 机器指令=4T=1/3us 指令周期=51/3=5/3us

平均指令执行速度 1/(5/3)=06MIPS

96设某计算机的CPU主频为8MHz，每个机器周期平均含2个时钟周期，每条指令平均有4个机器周期，试问该计算机的平均指令执行速度为多少MIPS若CPU主频不变，但每个机器周期平均含4个时钟周期，每条指令平均有4个机器周期，试问B机的平均指令执行速度为多少MIPS

1CLK=8MHz 平均指令执行速度1/(1/8M24)=1MIPS

2指令周期=441/8=2us 执行速度=1/(1/8M44)=05MIPS

97某CPU的主频为10MHz，若已知每个机器周期平均含有4个时钟周期，该机的平均指令执行速度为1MIPS，试求该机的平均指令执行速度为多少MIPS若CUP主频不变，但每个机器周期平均含有4个时钟周期，每条指令平均有4个机器周期，则该机的平均指令执行速度又是多少MIPS？由此可得出什么结论

1平均指令周期=1/1MIPS=1us T=1/f=01us T机=4T=04us

因为1us/04us=25 所以每个指令包含25个机器周期

2T=04us 速度=1/(04254)=025MIPS

3因为速度=08MIPS 所以T指=1/08us

因为T指=425T 所以T=1/8us 所以 f=1/T=8MHz

四、简答

1冯诺依曼机主机主要特点。

○1计算机由运算器、存储器、控制器、输入设备和输出设备五大部件组成。

○2指令和数据一同等地位存放于存储器内，并可按地址寻访。

○3指令和数据均用二进制表示。

○4指令由 *** 作吗和地址码组成， *** 作码用来表示 *** 作的性质，地址码用来表示 *** 作数在存储器中的位置。

○5采用存储控制原理，指令在存储器内按顺序存放。通常指令是顺序执行的，在特定条件下，可根据运算结果或根据设定的条件改变执行顺序。

○6机器以运算器为中心，输入输出设备与存储器间的数据传说通过运算器完成。

2计算机硬件主要技术指标，软件定义与分类。

计算机硬件主要技术指标：机器字长、存储容量、运算速度、主频等。

软件定义：看不见摸不着，由人们事先编制的具有各类特殊功能的程序组成。

分类：系统软件和应用软件。

3计算机组成部分与个部分作用。

运算器：用来完成算术运算和逻辑运算，并将运算的中间结果暂存在运算器内。

存储器：用来存放数据和程序。

控制器：用来控制、指挥程序和数据的输入、运行以及处理器运算结果。

输入设备：用来将人们熟悉的信息形式转换为机器能识别的信息形式，常见的有键盘、鼠标等。

输出设备：可将机器运算结果转换为人们熟悉的信息形式，如打印机输出，显示器输出等。

4总线定义与分类方法，系统总线定义与分类方法。

总线

定义：总线是连接多个部件的信息传输线，是各部件共享的传输介质。

分类：片内总线 系统总线 通信总线

系统总线

定义：系统总线是指CPU、主存、I/O设备（通过I/O接口）各大部件之间的信息传输线。

分类： 数据总线 地址总线 控制总线

5什么是总线标准，目前流行的总线标准有哪些。

所谓总线标准可视为系统与各模块，模块与模块之间的一个互连的标准界面。

ISA总线、EISA总线、PCI总线、RS—232C总线、IEEE-488(并行通信总线又称GP-IP总线)USB总线。

6三级存储器系统中各级存储器特点与用途，分哪两个层次。

○1主存 特点：随机访问、速度快。容量大。用途：存放CPU使用的程序和数据。

辅存 特点：容量大、速度慢、价格低、可脱机保存信息。用途：存放大量后备数据

缓存 特点：速度快、容量小、价格高 用途：用于主存与辅存之间作为缓冲，正在使用的程序和数据的付本。

○2缓存-----主存层次和主存---辅村层次。

7半导体存储器RAM与ROM特点与用途。

RAM特点：可读可写掉电后信息丢失，存临时信息。用途：主要做内存

ROM特点：只读不写掉电后信息不丢失，存长期信息。用途：主要做控制存储器

8动态RAM与静态RAM特点与用途，DRAM刷新方式与主要优点。

静态RAM特点：信息读出后，仍保持其原有状态，不需要再生。用途：用于Cache

动态RAM特点：靠电容存储电荷的原理来寄存信息。用途：组成内存/主存。

DRAM刷新方式

集中刷新：集中刷新是在规定的一个刷新周期内对全部存储单元集中一段时间逐行进行刷新，此刻必须停止读写 *** 作。

分散刷新：分散刷新是指对每行存储单元的刷新分散到每个存储周期内完成。

异步刷新：异步刷新是前两种方式的结合，它即可缩短“死时间”，又充分利用最大刷新间隔2ms的特点。

优点：单个MOS管组成，集成度高，速度较SRAM慢，价格低，

9Cache工作原理特点，地址映射方式与替换算法。

原理：利用程序访问的局部性，近期用到信息存于cache。

地址映射方式：直接映射、全相联映射、组相联映射、

替换算法：先进先出算法（FIFO）、近期最少使用算法（LRU）、随机法。

10主机与外设交换信息采用中断与DMA方式特点与应用场合。

中断方式：

特点：CPU与外设并行工作，效率高

应用场合：管理多种外设并行工作、进行实时处理、进行故障自动处理

DMA方式：

特点：

○1从数据传送看，程序中断方式靠程序传送，DMA方式靠硬件传送。

○2从CPU响应时间看，程序中断方式是在一条指令执行结束时响应，而DMA方式可在指令周期内的任一存取周期结束时响应。

○3程序中断方式有处理异常事件能力，DMA方式没有这种能力，主要用于大批数据的传送，如硬盘存取、图像处理、高速数据采集系统等，可提高数据吞吐量。

○4程序中断方式需要中断现行程序，故需保护现场；DMA方式不中断现行程序，无须保护现场。

○5DMA的优先级比程序中断的优先级高。

应用场合：高速设备 如硬盘

11I/O端口与接口的区别，I/O接口分类方法。

端口：接口内部寄存器有I/O地址号。一般分为数据口、命令口和状态口。

接口：若干端口加上相应的控制电路组成。

接口分类：按数据传送方式分串行接口和并行接口

按功能选择的灵活性分为可编程接口和不可编程接口

按通用性分为通用接口和专用接口

按数据传送的控制方式分为程序型接口和DMA接口。

12中断处理过程分成哪两个阶段各完成哪些任务

响应阶段：关中断、保护断点地址、转入中断服务入口地址

处理阶段：保护现场、执行用户编写的中断服务程序、恢复现场。

13与中断方式比较MDA方式主要特点是什么。

○1从数据传送看，程序中断方式靠程序传送，DMA方式靠硬件传送。

○2从CPU响应时间看，程序中断方式是在一条指令执行结束时响应，而DMA方式可在指令周期内的任一存取周期结束时响应。

○3程序中断方式有处理异常事件能力，DMA方式没有这种能力，主要用于大批数据的传送，如硬盘存取、图像处理、高速数据采集系统等，可提高数据吞吐量。

○4程序中断方式需要中断现行程序，故需保护现场；DMA方式不中断现行程序，无须保护现场。

○5DMA的优先级比程序中断的优先级高。

14什么是寻址方式，数据寻址方式有哪几种。

寻址方式：是指确定本条指令的数据地址以及下一条将要执行的指令地址的方法，它与硬件结构紧密相关，而且直接影响指令格式和指令功能。

数据寻址方式：立即寻址、直接寻址、隐含寻址、间接寻址、寄存器寻址、寄存器间接寻址、基址寻址、变址寻址、相对寻址、堆栈寻址。

15RISC主要特点与CISC相比较RISC主要优点。

特点：

选用使用频率较高的一些简单指令以及一些很有用但又不复杂的指令，让复杂指令的功能由频度高的简单指令的组合来实现；

指令长度固定指令格式种类少，寻址方式种类少；

只有取数/存数指令访问存储器，其余指令的 *** 作都在寄存器内完成；

采用流水线技术，大部分指令在一个时钟周期内完成；

控制器采用组合逻辑控制，不用微程序控制；

采用优化的编译程序。

○1充分利用VLSI芯片的面积。

○2提高计算机运算速度。

○3便于设计可降低成本提高可靠性。

○4有效支持高级语言程序。

16组合逻辑与微程序设计主要特点与应用。

组合逻辑：特点：速度快、复杂不灵活。应用：适用于RISC机。

微程序：特点：引入程序设计与存储逻辑技术，硬件软化，把一条机器指令用一段微程序来实现，存放控制存储器CM中。应用：系列机。

17什么是指令周期、机器周期、时钟周期 三者的关系如何。

指令周期：完成一条指令的时间，由若干机器周期组成。

机器周期：完成摸个独立 *** 作，由若干时钟周期组成。

时钟周期：最基本时间单位，由主频决定。

关系：时钟周期是最基本时间单位，由若干时钟周期组成机器周期，由若干机器周期组成指令周期。

”中断类型“指当出现需要时，CPU暂时停止当前程序的执行转而执行处理新情况的程序和执行过程。

在程序运行过程中，系统出现了一个必须由CPU立即处理的情况，此时，CPU暂时中止程序的执行转而处理这个新的情况的过程就叫做中断。

虽然现在win9x已经有了PNP(即插即用)功能，但是中断冲突仍然是不可避免的，其中最为容易发生冲突的就是IRQ、DMA和I/O。

计算机要采用中断的原因：例如打印输出，CPU传送数据的速度高，而打印机打印的速度低，如果不采用中断技术，CPU将经常处于等待状态，效率极低。而采用了中断方式，CPU可以进行其它的工作，只在打印机缓冲区中的当前内容打印完毕发出中断请求之后，才予以响应，暂时中断当前工作转去执行向缓冲区传送数据，传送完成后又返回执行原来的程序。这样就大大地提高了计算机系统的效率。

凡是能够引起中断原因或提出中断请求的设备和异常故障均称被称为“中断源”。

中断屏蔽也是一个十分重要的功能，所谓中断屏蔽是指通过设置相应的中断屏蔽位，禁止响应某个中断。这样作的目的，是保证在执行一些重要的程序中不响应中断，以免造成迟缓而引起错误。

win10系统中断是工作组的软件程序。

计算机的中断系统能够加强CPU对多任务事件的处理能力。中断机制是现代计算机系统中的基础设施之一，它在系统中起着通信网络作用，以协调系统对各种外部事件的响应和处理。中断是实现多道程序设计的必要条件。 中断是CPU对系统发生的某个事件作出的一种反应。

引起中断的事件称为中断源。中断源向CPU提出处理的请求称为中断请求。发生中断时被打断程序的暂停点成为断点。CPU暂停现行程序而转为响应中断请求的过程称为中断响应。处理中断源的程序称为中断处理程序。

系统中断，一般是硬件中断和软件中断的综合，“中断”是一个计算机术语，意思跟我们的请求差不多，鼠标、键盘、板卡或者是一些系统内核组件，要想为你服务，都要向系统提出申请，然后等待 *** 作系统的分配。

如果没有这个过程，你什么也干不了。CPU占用高的原因就是，系统要保持“随时”能为你提供服务，就必须保证它的优先权力。

扩展资料

导致win10系统中断的原因：

1、电池正处于休眠状态

2、多进程占用CPU

3、显卡驱动问题

4、硬件设备问题

参考资料来源：百度百科-系统中断

主机与I／O交换信息的控制方式有： (1)程序查询方式。其特点是主机与I／O串行工作。cPU启动I／O后时刻查询I／O是否准备好若设备准备就绪CPU便转入处理I／O与主机间传送信息的程序；若设备未做好准备则CPU反复查询“踏步”等待直到I／O准备就绪为止。可见这种方式CPU效率很低。 (2)程序中断方式。其特点是主机与I／O并行工作。CPU启动I／O后不必时刻查询I／O是否准备好而是继续执行程序。当I／O准备就绪时向CPU发中断请求信号CPU在适当的时候响应I／O的中断请求暂停现行程序为I／O服务。这种方式消除了“踏步”现象提高了CPU的效率。 (3)DMA 方式。其特点是主机与I／O并行工作主存和I／O之间有一条直接数据通路。CPU启动I／O后不必查询I／O是否准备好当I／O准备就绪后发出DMA请求此时CPU不直接参与I／O和主存间的信息交换只是把外部总线(地址线、数据线及有关控制线)的使用权暂时交赋予DMA仍然可以完成自身内部的 *** 作(如加法、移位等)故不必中断现行程序只需暂停一个存取周期访存(即周期挪用)CPU的效率更高。 (4)通道方式。通道是一个具有特殊功能的处理器CPU把部分权力下放给通道由它实现对外围设备的统一管理和外围设备与主存之间的数据交换大大提高了CPU的效率但它是以花费更多的硬件为代价的。 (5)I／O处理机方式。它是通道方式的进一步发展CPU将I／O *** 作及外围设备的管理权全部交给I／O处理机其实质是多机系统因而效率有更大提高。 主机与I／O交换信息的控制方式有：(1)程序查询方式。其特点是主机与I／O串行工作。cPU启动I／O后,时刻查询I／O是否准备好,若设备准备就绪,CPU便转入处理I／O与主机间传送信息的程序；若设备未做好准备,则CPU反复查询,“踏步”等待直到I／O准备就绪为止。可见这种方式CPU效率很低。(2)程序中断方式。其特点是主机与I／O并行工作。CPU启动I／O后,不必时刻查询I／O是否准备好,而是继续执行程序。当I／O准备就绪时,向CPU发中断请求信号,CPU在适当的时候响应I／O的中断请求,暂停现行程序为I／O服务。这种方式消除了“踏步”现象,提高了CPU的效率。(3)DMA方式。其特点是主机与I／O并行工作,主存和I／O之间有一条直接数据通路。CPU启动I／O后,不必查询I／O是否准备好,当I／O准备就绪后,发出DMA请求,此时CPU不直接参与I／O和主存间的信息交换,只是把外部总线(地址线、数据线及有关控制线)的使用权暂时交赋予DMA,仍然可以完成自身内部的 *** 作(如加法、移位等),故不必中断现行程序,只需暂停一个存取周期访存(即周期挪用),CPU的效率更高。(4)通道方式。通道是一个具有特殊功能的处理器,CPU把部分权力下放给通道,由它实现对外围设备的统一管理和外围设备与主存之间的数据交换,大大提高了CPU的效率,但它是以花费更多的硬件为代价的。(5)I／O处理机方式。它是通道方式的进一步发展,CPU将I／O *** 作及外围设备的管理权全部交给I／O处理机,其实质是多机系统,因而效率有更大提高

多重中断是指：当CPU执行某个中断服务程序的过程中，发生了更高级、更紧迫的事件，CPU暂停现行中断服务程序的执行，转去处理该事件的中断，处理完返回现行中断服务程序继续执行的过程。

实现多重中断的必要条件是：在现行中断服务期间，中断允许触发器为1，即开中断。

概念：中断是指在计算机执行期间，系统内发生任何非寻常的或非预期的急需处理事件，使得CPU暂时中断当前正在执行的程序而转去执行相应的时间处理程序。待处理完毕后又返回原来被中断处继续执行或调度新的进程执行的过程。

作用：计算机与外设之间的联系一般通过两种方法：一是通过CPU控制来进行数据的传送；二是在专门的芯片控制下进行数据的传送。我们所说的DMA，就是不用CPU控制，外设同内存之间相互传送数据的通道，在这种方式下，外设利用DMA通道直接将数据写入存储器或将数据从存储器中读出，而不用CPU参与，系统的速度会大大增加。

中断

介绍：

在计算机中，中断是指在计算机执行期间，系统内发生任何非寻常的或非预期的急需处理事件，使得CPU暂时中断当前正在执行的程序而转去执行相应的时间处理程序。待处理完毕后又返回原来被中断处继续执行或调度新的进程执行的过程。

如何防止中断冲突：

1、声卡：一些早期的ISA型声卡，系统很有可能不认，就需要用户手动设置（一般为5）

2、内置调制解调器和鼠标：一般鼠标用COM1，内置调制解调器使用COM2的中断（一般为3），这时要注意此时COM2上不应有其它设备

3、网卡和鼠标：此问题一般发生在鼠标在COM1口，使用中断为3，这时要注意通常网卡的默认中断为3，两者极有可能发成冲突。

4、打印机和EPP扫描仪：在安装扫描仪驱动程序时应将打印机打开，因为两个设备中串联，所以为了防止以后扫描仪驱动程序设置有误，一定要将打印机打开再安装扫描仪驱动程序。

5、 *** 作系统和BIOS：如果计算机使用了“即插即用” *** 作系统（例如win98），应将BIOS中PNP OS Installed设置为Yes这样可让 *** 作系统重新设置中断。

6、PS/2鼠标和BIOS：在使用PS/2鼠标时应将BIOS中PS/2MouseFunctionControl打开或设置为Auto，只有这样BIOS才能将IRQ12分配给PS/2鼠标用。

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