vivado中SRIO IP核的使用

                                                           vivado中SRIO IP核的使用

姓名：孙健强

学号：19021210841

【嵌牛导读】通常在信号处理板卡上，会用到FPGA和DSP的组合，这就涉及到了FPGA和DSP之间的通信问题。它们之间的通信协议是RapidIO协议，而在FPGA中则需要添加SRIO的IP核来实现与DSP的通信。

【嵌牛鼻子】XILINX FPGA、VIVADO、DSP、 RapidIO协议、SRIO

【嵌牛提问】如何使用vivado中自带的SRIO的IP核？

【嵌牛正文】：

一、srio基础知识

【高速接口-RapidIO】4、Xilinx RapidIO核详解

https://www.cnblogs.com/liujinggang/p/10072115.html

二、srio官方例程(vivado环境)

【高速接口-RapidIO】5、Xilinx RapidIO核例子工程源码分析

https://www.cnblogs.com/liujinggang/p/10091216.html

【高速接口-RapidIO】6、Xilinx RapidIO核仿真与包时序分析

https://www.cnblogs.com/liujinggang/p/10123498.html

三、回环测试

【硬核】FPGA进阶之路( 二) 如何将Xilinx SRIO控制器自环

http://blog.chinaaet.com/fyyysun/p/5100063900

打开vivado， 点击tools下的compile simulation libraries，设置Modelsim的路径以及生成libraries的位置

打开Modelsim安装路径下的modelsim.ini以及生成库路径下的modelsim.ini

将生成库路径下的modelsim.ini中所有IP库全部复制到安装路径modelsim.ini中的对应位置

把vivado工程中IP核文件下的sim文件中对应的.v文件或者.hdl文件添加到我们modelsim工程中

注意vivado不同版本需要不同的Modelsim版本，如果不是对应的可能在compile libraries显示编译不成功，vivado2018.3需要对应modelsim10.6

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