高速PCB中旁路电容的分析

　    1 引言

　　开关电源在高速数字系统设计中的应用越来越广泛，一个系统中往往需要用到多种电源。不仅电源系统容易受到干扰，而且电源供应时产生的噪声会给整个系统带来严重的EMC问题。随着系统体积的减小，工作频率的提高，系统的功能复杂化，这样就需要多个不同的嵌入式功能模块同时工作。只有各个模块具有良好的EMC和较低的EMI，才能保证整个系统功能的实现。这就要求系统自身不仅需要具有良好的屏蔽外界干扰的性能，同时还要求在和其他的系统同时工作时，不能对外界产生严重的EMI。

        因此，在高速PCB设计中，如何更好的滤除电源噪声是保证良好电源完整性的关键。本文分析了电容的滤波特性，电容的寄生电感电容的滤波性能带来的影响，以及PCB中的电流环现象，继而针对如何选择旁路电容做出了一些总结。本文还着重分析了电源噪声和地d噪声的产生机理并在其基础上对旁路电容在PCB 中的各种摆放方式做出了分析和比较。

　　2 电容的插入损耗特性、频率响应特性与电容的滤波特性

　　2.1 理想电容的插入损耗特性

　　EMI 电源滤波器对干扰噪声的抑制能力通常用插入损耗(InserTIon Loss)特性来衡量。插入损耗的定义为：没有滤波器接入时，从噪声源传输到负载的噪声功率P1和接入滤波器后，噪声源传输到负载的噪声功率P2之比，用 dB(分贝)表示。图1是理想电容的插入损耗特性，可以看出，1μF电容对应的插入损耗曲线斜率接近20dB/10倍频。

　　---观察其中某一条插入损耗特性，当频率增加时，电容的插入损耗值是增加的，也就是说P1/P2值是增加的，这意味着系统通过电容滤波以后，能够传输到负载的噪声减少，电容滤除高频噪声的能力增强。从理想电容的公式分析，当电容一定时，信号频率越高，回路阻抗越低，也即电容易于滤除高频的成分。从两个方面得出的结论是相同的。

　　---再观察不同电容所对应的曲线，在频率很低的情况下，各种电容所对应的插入损耗值是近似相同的，但是随着频率的增加，小电容的插入损耗值增加的幅度较大电容要慢一些，P1/P2值增加得也就较慢，也就是说大电容更容易滤除低频噪声。因而我们在设计高速电路板时，通常在电路板的电源接入端放置一个1～10μF的电容，滤除低频噪声;在电路板上每个器件的电源与地线之间放置一个0.01～0.1μF的电容，滤除高频噪声。

　　连接在电源和地之间的电容的阻抗可由如下公式计算：，电容滤波的目的是滤除叠加在电源系统中的交流成分，从上面的公式可以看出，当频率一定时，电容值越大，回路中的阻抗就越小，这样交流信号就越容易通过电容流到地平面上去，换句话说，即似乎电容值越大其滤波效果越好，事实上并非如此，因为实际电容并不具有理想电容的所有特性。实际电容存在寄生成分，这是构造电容器极板和引线时所形成的，而这些寄生成分可等效为串联在电容上的电阻与电感，通常称之为等效串联电阻(ESR)和等效串联电感(ESL)，其模型如图2的左半部分所示。如果忽略电容的寄生电阻则模型可等效为图2的右半部分。这样电容实际上就是一个串联谐振电路。在实际的电路或者PCB设计中，电容寄生电感的存在将对电容的滤波性能带来很大的影响，因此在系统设计时应该选择寄生电感比较小的电容。

　　2.2 实际电容的高频响应特性

　　从2.1 节我们知道，实际电容在工作时由于存在寄生电感的缘故，使得电容回路成为一个串联谐振回路。谐振频率为，式中：L为等效电感;C为实际电容。如图3所示，当频率小于f0时，呈现为电容;频率大于f0时，呈现为电感。所以，电容器更像是一个带阻滤波器，而不是一个低通滤波器。电容的ESL和ESR是由电容的构造和所用介质材料决定的，与电容容量无关。对于高频的抑制能力并不会因为更换大容量的同类型电容而增强。更大容量的同类型电容器的阻抗在频率低于f0时，比小容量电容器的阻抗小，但是，当频率大于f0时，ESL决定了二者的阻抗没有差别。可见，为了改进高频滤波特性，必须使用具有较低ESL的电容器。任何一种电容器的有效频率范围是有限的，而对于一个系统，既有低频噪声，又有高频噪声，所以通常要用不同类型的电容并联来达到更宽的有效频率范围。

　　3 利用电容模型分析PCB中的环流问题

　　电源去耦电容放置位置不当将会在印制电路板上产生很大的电流环。为了减少噪声，在高速印制电路板的设计当中，有一个很重要的原则是：减少信号电流环的面积。过去我们习惯于只考虑电流的流出起点、途径及终点，而很少去考虑电流的返回路径。在高频电路中，通常认为电源和地是等价的，因此电流的流出途径和返回途径将形成一个电流环，在这些电流环中，会由于种种原因，例如电容的寄生电感，PCB连线的固有电感等，使得环路的阻抗不为零，这样电流流经这一环路时将产生电势差，如果电流是变化的，则将产生辐射，对系统产生干扰。为了给电源滤波，在电路设计中常常要在电源和地之间加上一些旁路电容，在回路中增加旁路电容主要有两个目的，一是增加环路中存储电荷的能力，以免瞬间电流过大，产生地d噪声。二是适当的放置旁路电容的位置，可为噪声信号提供就近的地回路，减少电流环路的面积，从而减少了环路的电感。采用了旁路电容的回路中，由于欲滤除的噪声频率通常是高频交流信号，因而这样的回路仍旧将会对外产生辐射。为了减少这一辐射，我们需要尽可能的降低回路的阻抗，必须合理放置旁路电容的位置。图4显示了由于滤波电容放置位置不当产生的大电流环。

　　--- 图5为电流环的模型。从电流环模型中我们可以看出，环路中存在寄生电感，它们在高频状态下表现为环路的阻抗可导致供给电源产生尖峰，并会辐射电磁波从而干扰系统的其他部分。环路中Ll为电容管脚引线的封装电感;Lpc为电容管脚到器件电源或者地管脚之间的PCB传输线的寄生电感;Lic为器件管脚引线的寄生电感。另外，在前面我们讨论过电容本身也是具有寄生电感ESL的。这样回路的总电感为：L=2Ll+ 2Lpc+2Lic+ESL。由于环路的寄生电感将会给整个系统带来电磁干扰，产生电压尖峰，这个电压尖峰值同串联电感之间存在一定的关系，近似计算公式如下：

　　这里V为最大噪声电压尖峰值，△t为瞬态持续时间，△I为器件瞬态电流，△t、△I值可以从器件手册中查得。例如74HC的瞬态电流典型值Icc为 20mA，输出信号从零上升到Icc或者从Icc下降到零需要的时间为4ns，如果现在我们试图控制感性噪声的尖峰在100mV以内，那么由上面的公式我们可以求得串联电感L的最大值不超过20nH。在PCB板设计时，设计者可以通过以下几种方式来降低回路电感：选择寄生电感比较小的电容，降低ESL(不同型号电容的寄生电感值见表1);尽量使用贴片电容以减小电容引线长，降低Ll值;合理的放置电容，使用电源层或地平面层代替电源或者地传输线，减小电源地传输线电感Lpc;合理选择集成器件的封装，以降低Lic值，比如对于器件ADV478来说，PLCC封装的寄生电感比DIP封装的寄生电感要小2nH 到3nH。

　　4 电源扰动及地d噪声的产生机理

　　图6

　　---在高速PCB设计中，在电源管脚附近放置滤波电容就是为了消除电源扰动以及地d噪声的。系统加上旁路电容以后，由于电容寄生电感的存在，环路的总电感将增加，可能产生的噪声强度也就会更大。因此设计者应该尽可能的选择寄生电感小的旁路电容并合理的将其放置在PCB中。