半导体中名词“wafer”“chip”“die”的联系和区别是什么？

一、名词解释：

wafer：晶圆；是指硅半导体集成电路制作所用的硅晶片，由于其形状为圆形。

chip：芯片；是半导体元件产品的统称。

die：裸片 ；是硅片中一个很小的单位，包括了设计完整的单个芯片以及芯片邻近水平和垂直方向上的部分划片槽区域。

二、联系和区别：

                                                            一块完整的wafer

wafer为晶圆，由纯硅（Si）构成。一般分为6英寸、8英寸、12英寸规格不等，晶片基于wafer上生产出来。Wafer上一个小块晶片晶圆体学名die，封装后成为一个颗粒。一片载有Nand Flash晶圆的wafer首先经过切割，测试后将完好的、稳定的、足容量的die取下，封装形成日常所见的Nand Flash芯片。

                                                     die和wafer的关系

品质合格的die切割下去后，原来的晶圆成了下图的样子，是挑剩下的Downgrade Flash Wafer。残余的die是品质不合格的晶圆。黑色的部分是合格的die，会被原厂封装制作为成品NAND颗粒，而不合格的部分，也就是图中留下的部分则当做废品处理掉。

                                                          筛选后的wafer

扩展资料：

集成电路芯片的生命历程：芯片公司设计芯片——芯片代工厂生产芯片——封测厂进行封装测试——整机商采购芯片用于整机生产。

芯片供应商IDM：是集芯片设计、制造、封装和测试等多个产业链环节于一身的企业。

芯片供应商Fabless：是没有芯片加工厂的芯片供应商，Fabless自己设计开发和推广销售芯片，与生产相关的业务外包给专业生产制造厂商。与Fabless相对应的是Foundry和封测厂，主要承接Fabless的生产和封装测试任务，封测厂有日月光，江苏长电等。

参考资料：百度百科-晶圆

百度百科-芯片

百度百科-裸片

半导体封装是指将通过测试的晶圆按照产品型号及功能需求加工得到独立芯片的过程。封装过程为：来自晶圆前道工艺的晶圆通过划片工艺后被切割为小的晶片（Die），然后将切割好的晶片用胶水贴装到相应的基板（引线框架）架的小岛上，再利用超细的金属（金锡铜铝）导线或者导电性树脂将晶片的接合焊盘（Bond Pad）连接到基板的相应引脚（Lead）,并构成所要求的电路；然后再对独立的晶片用塑料外壳加以封装保护，塑封之后还要进行一系列 *** 作，封装完成后进行成品测试，通常经过入检Incoming、测试Test和包装Packing等工序，最后入库出货。

半导体封装一般用到点胶机+胶水环氧树脂，焊机+焊膏。典型的封装工艺流程为：划片、装片、键合、塑封、去飞边、电镀、打印 、切筋和成型 、外观检查、 成品测试 、包装出货。

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首先说明一下，半导体中所谓的工艺指得是IC在由设计文件生产成为实体的过程步骤和技术（这是我自己组织的语言，明白是什么意思就成了），比如你所说掺杂、注入、光刻、腐蚀都是现在比较流行也是传统的半导体生产工艺。 而扩展到集成电路上，这个“工艺”一般又多了一层“特征尺寸”的感念，比如人们常说“我这CPU是core2duo，用得是45nm的工艺”。当然现在最先进的工艺已经达到了30nm左右，甚至在实验室中有更低的数值得以实现.

至于你说的MOS，CMOS这些东西，我个人认为不能称之为“工艺”，而是电路组成形式。以CMOS为例，它的意思是“互补对称型MOS”，即电路中的基本单元是一个反向器（由一个NMOS和一个PMOS构成），--整个电路都是由这种单元组成，因此它是一种电路组成形式。

工艺和电路组成形式的对应关系是：CMOS为单极型工艺（口头上即称为COMS工艺，所以容易产生你的那种误解），是数字电路的代表；TTL电路形式为双极型工艺（口头上就是双极型），是模拟电路的代表。而前面所说的“掺杂、注入、光刻、腐蚀”多用于单极型工艺，双级型也类似但具体还是有些不同的。

die bond,wire bond则是封装工艺。

如果我去回答面试的那几个问题时，我基本上就从“特征尺寸”和工艺流程上说一下。中国大陆现在能做的最小工艺尺寸就是45nm（如INTEL的大连厂）了，要算上台湾的话，基本能做到世界最先进的水平（TCMC和中芯国际），不过知识产权是不是自己的就不好说了。第三个问题我会反问下考官是是指的电路形式还是工艺流程，因为现在有些企业负责的人自己业务都搞得不怎样，问问题也比较奇怪

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