Cadence virtuoso使用Calibre的DRC仿真

Cadence virtuoso使用Calibre的DRC仿真,第1张

1实现功能

在科研时,在做virtuoso版图设计时,需要对版图进行DRC校验。

2实现方法

第一步:打开Cadence virtuoso的版图界面,执行菜单栏命令Calibre的Run DRC

第二步:会让我们选择DRC设置,这里,如果我们之前做过DRC仿真则可以调用之前做的DRCset,如果没有,则需要选择Cancel

第三步:选择第一个Rules,然后点击右边的

第四步:选择该工艺文件中,选择对应的DRC校验文件,然后点击OK。

第五步:选择完毕后,界面如下所示

第六步:另外Inputs中这个地方必须要勾选。

第七步:然后点击Run DRC。

第八步:如果做过DRC校验,则会让你选择是否覆盖之前的结果,点击OK。

第九步:稍等片刻

第十步:仿真结束

第十一步:DRC校验结果,对比工艺手册的rules对版图进行修改,然后再进行DRC校验。

第十二步:将DRC窗口关闭

第十三步:选择保存设置文件,以供下次使用。

第十四步:保存自己想保存的位置,并命名。

第十五步:点击OK。

virtuoso模拟版图,p管有两个栅如下:

1创建版图

layout-lay XL-create new(在tool-library manager 中打开版图)

2原理图器件调入版图

connectivity-generate-select from source

3显示版图

shift+f(ctrl +f 则只有丝印)

4显示连线关系

option-display-nets

5连线

按p开始连线,按回车终止连线

6添加过孔

create-via然后选择哪一层到哪一层的过孔

7guardring

对于NMOS为(via)M1-PSUB(或者cont-PSUB)

对于PMOS为(via)M1-NWELL(或者cont-NWELL)

半包围即可。

IC版图设计主要有以下几个比较牛的软件(用不用服务器都可,PC直接能跑客户端的):

Cadence EDA软件

数字系统模拟工具Verilog-XL;

电路图设计工具Composer;

电路模拟工具Analog Artist;

射频模拟工具Spectre RF;

版图编辑器Virtuoso Layout;

布局布线工具Preview;

版图验证工具Dracula等

Synopsys EDA软件

综合平台 DC Ultra

布局布线系统 Apollo-II

三维全芯片参数提取 Star-RCXT

层次化物理验证 Hercules

门级静态时序分析 PrimeTime

高质量的IP库 DesignWare Library

自动测试向量生成 TetraMAX ATPG

Mentor graphics EDA软件

具有EDA全线产品,包括:

仿真工具Eldo、 ModelSim等 ;

验证工具Calibre 系列;

IC设计工具icstudio;

FPGA设计系统;

IC测试软件FastScan 、DFT、DFM等 ;

PCB设计系统

Zeni EDA软件

九天(Zeni)系统是熊猫(Panda)系统的改进版,由我国在80年代后期自主开发,面向全定制和半定制大规模集成电路设计的EDA工具软件。

覆盖了集成电路设计的主要过程,包括:

基于语言的和基于图形的设计输入,各个级别的设计正确性的模拟验证(ZeniVDE);

交互式的物理版图设计(ZeniPDT);

版图正确性验以及CAD数据库 (ZeniVERI)。

推荐用cadence软件,这个“最大”,呵呵~本人也用过,cadence ic5141 资料比较多,网上破解也比较全,个人电脑就能用(要在XP用得先装个虚拟机),现在已经有cadence ic610 的破解版了

版图设计可以参考下面的软件:

Cadence EDA软件

数字系统模拟工具Verilog-XL

电路图设计工具Composer

电路模拟工具Analog Artist

射频模拟工具Spectre RF

版图编辑器Virtuoso Layout

布局布线工具Preview

版图验证工具Dracula等

扩展资料:

利用EDA工具,电子设计师可以从概念、算法、协议等开始设计电子系统,大量工作可以通过计算机完成,并可以将电子产品从电路设计、性能分析到设计出IC版图或PCB版图的整个过程的计算机上自动处理完成。

Cadence Allegro系统互连平台能够跨集成电路、封装和PCB协同设计高性能互连。应用平台的协同设计方法,工程师可以迅速优化I/O缓冲器之间和跨集成电路、封装和PCB的系统互联,约束驱动的Allegro流程包括高级功能用于设计捕捉、信号完整性和物理实现。

由于它还得到Cadence Encounter与Virtuoso平台的支持,Allegro协同设计方法使得高效的设计链协同成为现实。

参考资料来源:百度百科-Cadence

参考资料来源:百度百科-eda (电子设计自动化)

以上就是关于Cadence virtuoso使用Calibre的DRC仿真全部的内容,包括:Cadence virtuoso使用Calibre的DRC仿真、virtuoso模拟版图,p管为什么有两个栅、画IC版图用什么软件做服务器等相关内容解答,如果想了解更多相关内容,可以关注我们,你们的支持是我们更新的动力!

欢迎分享,转载请注明来源:内存溢出

原文地址: http://outofmemory.cn/sjk/9881074.html

(0)
打赏 微信扫一扫 微信扫一扫 支付宝扫一扫 支付宝扫一扫
上一篇 2023-05-03
下一篇 2023-05-03

发表评论

登录后才能评论

评论列表(0条)

保存