要说ASIC设计者的经验有所提示的话，那么将来的百万门级可编程逻辑设计中验证会耗费大半的设计周期。随着设计复杂度的增加，传统的设计验证方法如仿真需要其它技术和工具的补充，因为这些可编程芯片系统（SOP

摘 要 ：本文介绍了可编程逻辑器件开发工具Quartus II 中SingalTap II 嵌入式逻辑分析器的使用，并给出一个具体的设计实例，详细介绍使用SignalTap II对FPGA调试的具体方