引言随着系统时钟频率的提高，时钟偏斜和干扰开始成为IC工程师重点考虑的问题。增大时序电路的时钟频率，减小时序电路的容差能提升未来的系统性能。低偏斜时钟缓冲器和锁相环时钟驱动器将帮助设计人员设计出速度、

星载计算机系统处于空间辐照环境中，可能会受到单粒子翻转的影响而出错，三模冗余就是一种对单粒子翻转有效的容错技术。通过对三模冗余加固电路特点的分析，提出了在ASIC设计中实现三模冗余的2种方法。其一是通

由于与深亚微米标准单元ASIC相关的非重复性工程费用（NRE）越来越大，设计周期又很长，因此利用结构化ASIC进行定制IC设计的吸引力正变得越来越大。结构化ASIC能以极具竞争力的单位成本提供优秀的硅

平台ASIC架构突破传统ASIC设计局限性采用先进半导体工艺，结构化ASIC平台可以提供更多经预定义、预验证和预扩散的金属层，并支持各种存储器接口，能简化接口设计和时序问题。本文详细介绍了结构化AS