dbs1,2代表什么是什么意思ads仿真

DBS1是一种仿真技术，它可以模拟及分析复杂的系统和环境，从而帮助研究人员了解系统、识别优势和不足，并且更好地识别可能出现的问题。

DBS1是一种数字仿真技术，它可以分析系统的行为，并且使用数字模型来模拟真实系统的行为。它可以用来研究系统的结构、性能和可靠性，以及系统内部的构成、运行过程和可能出现的不良情况。它可以帮助研究人员预测系统的行为，并且能够检测和处DBS1是一种仿真技术，它可以模拟及分析复杂的系统和环境，从而帮助研究人员了解系统、识别优势和不足，并且更好地识别可能出现的问题。

DBS1是一种数字仿真技术，它可以分析系统的行为，并且使用数字模型来模拟真实系统的行为。它可以用来研究系统的结构、性能和可靠性，以及系统内部的构成、运行过程和可能出现的不良情况。它可以帮助研究人员预测系统的行为，并且能够检测和处理系统中的故障和可能出现的问题。理系统中的故障和可能出现的问题。

首先声明，这是copy的

ADSI 对象: IIS:

IIsObject

IIsLogModules

ADsPath : IIS://MachineName/LOGGING

IIsWebService Name : W3SVC

ADsPath : IIS://MachineName/W3SVC

Class : IIsWebService

GUID : {8B645280-7BA4-11CF-B03D-00AA006E0975}

Parent IIS : //LocalHost

Schema IIS : //LocalHost/schema/

IIsMimeMap

ADsPath : IIS://MachineName/MIMEMAP

IIsWebService 层次

IIsWebInfo:

ADsPath : IIS://MachineName/W3SVC/INFO

IIsWebServer

ADsPath : IIS://MachineName/W3SVC/N MachineName 是机器名

比如LocalHost N是机器上IIS开的虚拟站点(域名)的顺序号。

第一个站是1，第2个是2

IIsFilters

ADsPath : IIS://MachineName/W3SVC/Filters 或是

IIS://MachineName/W3SVC/N/Filters N是IIS上虚拟站点的顺序号

在IIS里添加一个虚拟目录的代码例子你可以到 搜索引擎里

输入 ADSI 就可以找到相关连接。 不过国内的这个例子都是抄来抄去。都是同一个

例子。关键是要摸准上面的关系。 也就是GETOBJECT时的顺序

ADS（Antenna Design System）中的驻波比（VSWR）通常表示为驻波比（VSWR）或比值。这是一个无单位的数值，表示输入和输出信号之间的阻抗失配程度。驻波比越高，阻抗失配越严重，信号传输效率越低。驻波比通常用1:1的理想传输线的VSWR作为参考，表示输入输出阻抗完全匹配。

在ADS中查看驻波比的方法如下：

1 打开ADS软件，并创建一个新的天线设计项目。

2 添加要测试的天线元件，例如反射板、引向器、定向器等。

3 在设计项目中添加一个S参数（S-parameters）分析工具，可以通过点击菜单栏中的Analysis > S Analysis来打开S参数分析工具。

4 在S参数分析工具中，选择一个合适的模式（如传输、反射、损耗等）。

5 在S参数分析工具的下方，您可以找到一个名为VSWR的工具。点击VSWR工具，然后选择所需的端口（通常选择远端端口或近端端口）。

6 在VSWR工具中，您可以看到输入和输出端口之间的VSWR值。此值以dB为单位显示。

在ADS中，可以使用VSWR工具来评估天线设计的性能，并进行优化以降低VSWR。通常，高性能的天线设计应该将VSWR控制在15:1以下，但对于某些应用，可能需要更高比率的VSWR，例如无线通信系统中的天线设计。

希望能赶紧拿到现在开发的产品的相关模型，早点创造一个新的技术和学科，不管是SI测试、调试、仿真，当你做从0到1的先驱者时，会有很多很多坎坷，而在大多数问题周围没有人能support你、没有人能跟你讨论的时候，需要大量的绞尽脑汁、大量的耐心、大量的试错、大量拓展交往新领域的专业人士去咨询，所有的一切都需要一个很关键的常量----时间。值得庆幸的是随着HFSS和ADS的熟悉，原本看的模模糊糊的无法用我知道的仿真工具仿真的Intel模型看的竟然有些清楚了，希望将来有一天也能搞定Intel平台仿真，然后开始我的下一步技术学习计划，车开了，得赶紧上车。

ADS有自带的DDR BUS Simulator，与传统Transient仿真器对比，DDR BUS Simulator具有如下特性：

1 采用创新的统计学算法，可以快速计算出低至1E-16误码率下的DQ和DQS信号的眼图特性

2 基于用户定义的眼图模板自动进行眼图余量测量

3 对于TX/RX模型，ADS支持包括内嵌的行为及模型、IBIS模型、Spice模型、和Verilog-A模型的灵活组合、

4 对于内嵌的TX行为级模型，支持de-emphasis和非对称的上升、下降沿设置，以更好地反应实际芯片的工作状态

5 对于内嵌的RX行为级模型，支持CLTE(均衡)算法的设置

6 支持仿真通道间串扰

在ADS PCB级仿真控件SIPro中提取S参数后，建立原理图结构进行仿真和调试，较为快速和便捷。总的来说，拓扑为TX端-PCB传输线-接口-RX端

TX/RX端模型：由芯片厂商提供，IBIS模型，Spice模型，Verilog-A模型

PCB传输线模型：由主板设计方提取，S参数模型，SnP文件/ckt文件

接口模型：由接口厂商提供，S参数模型，SnP文件/ckt文件

1 TX模型参数介绍

Stimulus：激励源设置

EQ：均衡参数设置

Electrical：负载参数设置

Jitter：抖动设置

Display：模块显示项目

Config file：导入模型文件

2 RX模型参数介绍

EQ

Electrical

Jitter

3 Eye_Probe眼图探头介绍

BER Value: DDR4测试标准定义1e-16，在测量Hight@BER和Width@BER两个参数时所对应的BER值，眼图裕量测量基于这个BER Value

DDR4 Mask：DDR4模板定义，可使用标准模板，也可以导入自己定义的模板

眼图探针测量项目，有眼图，眼高，眼宽，抖动，浴盆曲线，jitter，波形等

4 其他的如仿真速率等就不介绍了，开始仿真

8组DQ和对应DQS眼图

写DQS-DQ时序，DQS边沿跳变对应DQbit中心，可以用来测量写时序timing要求

读DQS-DQ时序，DQS边沿对DQ bit边沿，可以用来测量读时序timing要求

TXDQ1 de-emphasis 加5db对波形的影响

睡觉，后面再写

就和量子力学和广义相对论一样，AdS/CFT是理解很多其他工作的基础，而且它也提供了一个有趣也很用的供我们思考物理的图像。虽然没有做过直接相关的工作，但是倒是看过很多这方面的讲义或是书，但是有点像量子力学的初期阶段，只记住了各种各样的“事实”，却没有有一个完整的可以用来当做核心的框架，所以很多时候就只能是是而非的说上几句，又要温故而知新了。当然最经典的讲义是AGMOO99年的一个综述，差不多300页，Maldacena亲自参与。还有就是Ammon&Erdmenger 2015年编的教材，从场论，相对论讲起，到弦论，超弦最后AdS/CFT，再加上各种应用，可是说是无所不包了。看过这些东西，并不是看懂了多少，更多的意义是，以后遇到问题知道到那本书那页去寻找答案。

最喜欢的讲义是Jared Kaplan的“Lectures on AdS/CFT from the Bottom up”，这个from the Bottom up就是完全从场论，更确切地说是从有效场论的方面来理解。这个角度就回避了弦论，而且每一步计算都告诉你他在干什么，还有为什么这么算。给我的感觉就是Griffiths相对于量子力学。

这次又发现一个好的讲义by Veronika E Hubeny。给我的感觉就是Feynman volume3相对于量子力学。而且Hubeny是和厉害的女物理系家啊。为什么这个很特别呢？因为作者的背景跟扎根于广义相对论而不是场论的，讲义里面一直倡导的就是：相对论是很漂亮，但是之前的只限于很小的研究圈子，只有一些相对论作家，宇宙学家或者少数天文学家在研究，其他人都有点爱答不理的。看吧，现在是相对论来帮助你们提供新方法了！管你是做场论，凝聚态，信息物理，全都给我好好学！

口号就是：隐藏在所有场论里的，不管是是弱还是强耦合，都是量子引力理论！

弦论值得让人惊叹的不是什么所有物质都是有一维的弦构成，弦理论有11维空间这种看似狂野的假设，而是弦论里面精巧的结构如何解决像量子化，强耦合，如何消除奇异性和如何从更深层的结构解释时空这些场论很难或是根本无法解释的问题的。比如关于强耦合，当耦合很强，也就是弦之间的相互作用很强，量子修正不可控的时候，弦论里面具有S-duality，就是说我们可以重新选取自由度，这时的物理不在描述基本弦而是一些D膜，这些D膜上的物理和之前等价，但是D膜之间只是弱相互作用，量子修正比较好控制了。这时我们可以引入一个新的参数：D膜的数量。当有很少的D膜放在一起的时候，我们忽律他们对时空的影响，单纯考虑D膜在平坦时空的动力学。D膜的动力学是由长在他们身的开弦还有在膜之间传递的闭弦来描述。当很多D膜重叠在一起的时候，就会弯曲时空成为类似于黑洞的结构。接下来考虑低能近似，在这个近似下，对于前一种情况，开弦与其他的自由度分离开来，开弦的动力学由4维平坦空间的规范场论描述；对于后一种情况我们相当于只考虑距离D膜很近处的几何结构，其他的自由度因为引力红移也不用考虑，这个近膜的几何结构就是5维的AdS 空间。一个很自然的猜想就是在D膜的个数和弦论耦合强度取值在某些区域的时候，以上两种描述都成立，我们想象成这个规范场论的理论存在于AdS的边界上。这就是Maldcena的AdS/CFT猜想。这个猜想已经经过了很多不同方面的验证，虽然还没有一个严格的证明，但是越来越多对之的态度不再是“这个猜想正确吗？”而是“怎么去理解这个猜想？”还有“怎么应用这个猜想？”

一个自然的想法是从表示论来看，引力子是一个自旋为2，那么它可能是两个自旋为1的规范场粒子构成的。但是这个想法很容易就被Weinberg-Witten no-go理论打破。但是全息的原理建议说，这个引力子是存在更高一维的空间的，这就躲过了no-go原理。所以我们的全息规范场论要能表述引力，需要存在额外一个“维度”：一个影响场论行为的局域的量。在场论里一个这样的量是能标。因为重整化的原因，在不同的能量标准下，场论会发生改变。

然后想要这个额外的维数是宏观的，而且从我们对场论的经验里得知低耦合的场论微扰理论是无论如何也不能来描述引力的，所以我们就需要这个规范场论在打一个能区里面都是有强相互作用。用共形场论就可以很容易达到这一点，因为共形场论的是不随能标发生变化的，这样我们可以在所有能标下具有强耦合。增加的维数的同时，我们同时增加了自由度，为了克服这个问题，我们就要考虑一个具有很多自由度的共形场论，也就是要取所谓的‘t Hooft极限。

一个强耦合的场论又是不可控的，这让我们很难进行研究。我们可以引入超对称来解决这个技术问题。共形场论具有共形对称性，当我们同时改变空间尺度和能量尺度，这个理论应该不变，满足这个条件的最一般的几何就是AdS空间，这样我们就可以把能量的倒数当做AdS的径向空间。这样，我们就有了一个初步的AdS/CFT的对应了。但是因为引入了超对称，场论就有了额外的超对称粒子自旋为0的粒子。这些粒子对应了更多额外的维度，这就恰好印证了超弦理论的10维空间的要求。

比起严格的证明这个猜想，更重要的是我们要知道怎样从一个图景的物理量得到另一个图景的物理量。

在场论里面满足所有对称性的态是真空态，这就对应了纯的AdS空间。如果我们考虑激发态，一些对称性会被破坏，相对应几何空间也应该是被扰动的AdS。当这个激发态能量很小的时候，我们还是忽律这个扰动，这激发态可以对应于在纯AdS空间传播的一些场。比如我们考虑在AdS空间里一个粒子因为负曲率向空间中心滑入，这个过程在规范场论表述为一个局域 激发的扩散。

这些在引力空间里的场要满足由这个激发态确定的边界条件。

给定AdS空间量子引力理论的边界条件，理论的路径积分就是相当于这个边界条件的一个函数。在边界上，这个路基积分相当于场论的带有源的配分函数。这个源和边界条件有一个一一对应。有了配分函数，我们就可以在场论里求得所有的关联函数。在引力理论里，我们可以想象这些关联函数是通过AdS空间联系起来的。比如对于2点的关联函数，我们近似对应为连接这两点的AdS空间的测地线表示下的Green函数。规范场里一个非局域的可观测量是Wilson loop，这个loop可以描述场论电荷之间的作用势能，有一个很复杂的表达。但是在引力里，这个loop对应了由这个loop对应的弦划过的2维曲面。除了常规的可观测量。还可以考察场论一个子边界空间与其补边界空间的纠缠熵。这个纠缠熵对应了以这个子空间为边界的在AdS空间里面的一个测点面。

如果我们考虑更高的激发态，那么就需要考虑对AdS空间的改变了。这时高能量的激发态就再简单对应一个AdS空间的试探粒子，而是对应了一些弯曲时空的D膜。

当能量再高，高到相当于把所有可能的自由度都激发起来，那么可以对应到AdS空间里更复杂的几何。这时如果考虑一个统计样本而不是一个纯的量子态，那么对应就对应了AdS空间中的黑洞。场论里一个偏离热平衡的激发回复热平衡的过程就可以描述为一个粒子调入黑洞的过程。

在数据采集系统中，高性能的DSP能够满足算法结构复杂、运算精度高、速度快的要求，CPLD具有内部延时小、速度快、全部逻辑由硬件完成等优点，因此，本系统设计了一种基于DSP+CPLD的高速信号采集系统，选用DSP芯片TMS320F2812（以下简称2812）作为核心处理器，EPM240T做逻辑控制元件。AD芯片采用美国TI公司的ADS8556，它是16位6通道可以同时采样的模数转换器。本文详细介绍了基于ADS8556的六通道高速数据采集系统的软硬件设计。ADS8556的特点及其工作原理

1ADS8556的特点

ADS8556是16位高精度A/D，各自基于连续逼近寄存器原理，构架是基于电荷再分配原理，具有采样保持功能。

ADS8556包括6个16位模数转换器（ADC），6个模拟输入组成3个通道组，这些通道组可以并行采样，保留了信号的相对相位信息。独立的转换开始信号可以控制每个通道的转换，可以是4个通道或者是6个通道一起转换。器件支持单端、差分模拟输入信号，范围可以是±4Vref或者±2Vref，最大输入电压可以达到±12V，其中Vref为内部参考电压，可取25V或30V。ADS8556可以工作在硬件模式或软件模式，硬件模式下，器件功能通过引脚接口配置；软件模式下，功能设置将只能通过其内部32位控制寄存器进行，对应的引脚设置将被忽略。ADS8556提供一个可选择的并行或串行接口，其中，并行接口模式下采样速率可达到630kSa/s。ADS8556的数据可以采用8位或16位传送方式。

2ADS8556的工作原理

ADS8556有两种接口模式，本文中采用并行接口模式的16位传送方式。下面对它的工作原理进行分析。

在进行模数转换时，转换信号COV_A/B/C用来控制2通道或4通道或6通道ADC进行同时采样。如果将COV_A/B/C3个引脚连接在一起，即6个ADC使用同一转换信号，就可以对6个ADC进行同步采样。选择ADC在COV_X的上升沿置为保持模式，并开始转换。转换信号上升沿过后，ADC开始转换，转换期间BUSY信号保持高电平，转换完成时间为126μs，转换结束BUSY信号返回低电平。BUSY信号的下降沿触发ADC的跟踪模式，通过16位并行接口从输出寄存器将数据读出。读取数据时，片选信号/CS先置低，读信号/RD每变低一次，DSP从16位总线上读取1个通道的数据，需要读取6次将6通道数据读走，16位并行接口模式读取时序如图1所示。系统硬件设计

1前置放大电路

ADS8556的输入通常由一个运算放大器驱动，以确保采集时间内正确的稳定调节。就驱动能力、噪声和偏移性能而言，TI的OPA2211可达到确保高输入信号质量所必需的诸多要求。本文中采用OPA2211放大器作A/D的前置放大。

将2812的地址线XA0、XA1、XA2和/XCS0分别连接至EPM240T的IO口上。/XCS0对应的地址映射为0x002000-0x003FFF，2812对这个区域的地址进行访问时，相应片选端/XCS0被置为低电平，地址线上出现所要读取或者写入的地址。为了节省映射空间，本文设计通过EPM240T对/XCS0和XA1、XA2进行地址译码来实现对ADS8556的控制。ADS8556的片选信号/CS、复位信号/RST分别连接到EPM240T的IO口上，3通道组的启动转换信号CONV_X连接到一起并和EPM240T的IO口连接，用来启动6通道的同步转换。2812的外部中断INT1连接BUSY信号，单次转换结束后，BUSY信号变低，向2812申请中断。2812的读信号/XRD与ADS8556的读信号/RD相连接，用来读取转换结果。将ADS8556的16位数据线和TMS320F2812的16位数据线直接相连。

ADS8556需要4个独立的供电电源：ADC的模拟供电AVDD，数字接口的IO供电，模拟输入的高电压供电HVDD和HVSS。AVDD为内部ADC提供电源，本文设置为5V。高压供电(HVSS和HVDD)用来为模拟输入供电，本文将HVDD设置为12V，HVSS设置为-12V。ADS8556连接外围电路时，在AVDD、BVDD和HVSS引脚须接10μF和01μF电容组成去耦电路，为达到好的去耦效果，电容要尽量靠近器件。BVDD供电仅用于驱动数字IO缓冲器，范围为27～55V。本文将其连接至33V，在DSP的数据总线和ADS8556的16位数据总线相连接时，DSP的接口电压为33V，ADS8556的接口电压也为33V，不需要进行电平匹配，方便电路的连接。ADS8556其他关键引脚的连接及其功能如表1所示。

3数据存储设计

TMS320F2812具有128KB的FLASH空间，而其内部SARAM数据存储空间只有18KB，在高速数据采集系统中，由于在线采集的数据量比较大，因此需要对2812的数据存储空间进行外部扩展。

本文选择IS61LV25616作为数据存储器，它是一个高速的SRAM，由高性能CMOS技术制造而成，供电电压为33V，其空间大小为256K×16。IS61LV25616与2812的接口电路如图4所示，/CE片选信号引脚接2812的/XCS6片选信号，其映射地址空间范围为0x1000000x180000；/OE、/WE为低电平有效，分别与DSP的读写引脚相连接；地址线A[17:0]与2812地址线XA[17:0]相连，16位数据总线与DSP的XD[15:0]数据总线连接，完成

unsignedintAD_DATA_CH4[20000];

#pragmaDATA_SECTION(AD_DATA_CH4,"ad_data_ch4")

unsignedintAD_DATA_CH5[20000];

#pragmaDATA_SECTION(AD_DATA_CH5,"ad_data_ch5")

unsignedintAD_DATA_CH6[20000];

#pragmaDATA_SECTION(AD_DATA_CH6,"ad_data_ch6")

本设计将AD转换的数据，存储到外部SRAM中，因此需要将存放采集数据的数组定义在SRAM对应的地址映射空间，通过CMD文件编写MEMORY和SECTION指令对DSP存储空间进行配置。MEMORY中定义SRAM对应的映射空间的语句如下：

EXRAM:origin=0x100000,length=0x080000

SECTION中将存放6通道数据的数组分配到EXRAM中，语句如下：

ad_data_ch1:>EXRAM,PAGE=1

ad_data_ch2:>EXRAM,PAGE=1

ad_data_ch3:>EXRAM,PAGE=1

ad_data_ch4:>EXRAM,PAGE=1

6通道数据写入外部SRAM对应的地址空间，由于在测试时将数据线上没有数据，默认为0xFFFF，在编写程序时让每个地址对应的数据分别减去1、2、3、4、5、6，从而得到0xFFFE、0xFFFD、0xFFFC、0xFFFB、0xFFFA、0xFFF9。从CCS33的MEMORY窗口查看写入数据的结果是否正确。其中通道1和通道2的写入数据结果如图8所示。

由图8可以看出，2812相应中断后在356μs的时间内完成了读取6通道数据，并将其准确存入了外部SRAM中，显示结果正确。而一次AD转换的时间为126μs，可见在一个5μs的采样读取周期内能够完成数据的转换与存储，而且时间上还有剩余。由以上测试可知，在每通道采样速率200kSa/s的要求下，本系统可以正常工作。

本设计利用新型的模数转换芯片ADS8556，结合DSP数据处理速度快和CPLD并行处理能力强的特点，设计了能够实现6通道数据同步采集的高速数据采集系统，并对系统的采集速度进行了测试，证明其在每通道采样速率200kSa/s下可以正常工作。本系统接口电路简单，控制方便，可以应用到多种模拟信号的采集系统。

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