vhdl语言中取余符号rem如何用举例说明。

rem是vhdl标准库numeric_std里面定义的函数

mod(取模)/rem(取余)对于两个正的输入来说结果一致 否则有区别

A rem B = A - ( A / B ) B --余数运算符 利用 *** 作数A决定结果的正负号

A mod B = A - B N --取模运算符 利用 *** 作数B决定结果的正负号

并且都是用于仿真而不可综合的

5 mod 3 = 2

(-5) mod 3 = 1

5 mod (-3) = -1

(-5) mod (-3) = -2

5 rem 3 = 2

(-5) rem 3 = -2

5 rem (-3) = 2

(-5) rem (-3) = -2

VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,诞生于1982年。1987年底，VHDL被IEEE和美国国防部确认为标准硬件描述语言 。自IEEE-1076（简称87版）之后，各EDA公司相继推出自己的VHDL设计环境，或宣布自己的设计工具可以和VHDL接口。1993年，IEEE对VHDL进行了修订，从更高的抽象层次和系统描述能力上扩展VHDL的内容，公布了新版本的VHDL，即IEEE标准的1076-1993版本，简称93版。VHDL和Verilog作为IEEE的工业标准硬件描述语言，得到众多EDA公司支持，在电子工程领域，已成为事实上的通用硬件描述语言。

VHDL语言是一种用于电路设计的高级语言。它在80年代的后期出现。最初是由美国国防部开发出来供美军用来提高设计的可靠性和缩减开发周期的一种使用范围较小的设计语言 。

VHDL翻译成中文就是超高速集成电路硬件描述语言，主要是应用在数字电路的设计中。它在中国的应用多数是用在FPGA/CPLD/EPLD的设计中。当然在一些实力较为雄厚的单位，它也被用来设计ASIC。

VHDL主要用于描述数字系统的结构，行为，功能和接口。除了含有许多具有硬件特征的语句外，VHDL的语言形式、描述风格以及语法是十分类似于一般的计算机高级语言。VHDL的程序结构特点是将一项工程设计，或称设计实体（可以是一个元件，一个电路模块或一个系统）分成外部（或称可视部分,及端口）和内部（或称不可视部分），既涉及实体的内部功能和算法完成部分。在对一个设计实体定义了外部界面后，一旦其内部开发完成后，其他的设计就可以直接调用这个实体。这种将设计实体分成内外部分的概念是VHDL系统设计的基本点。

以

2%5

为例:

首先,2/5=0

,

所以

2%5

商为

0

,

按照数学上的定义应该有

被除数=除数X商+余数,

所以,2=50+余数,即

2=50+2

故

2%5=2

说白了就是小数字对大数字取模就等于小数字本身

要验证也很简单,写个程序直接输出

2%5就可以看到模的值了

由于c中提供的取模(%)是用来求两个整数相除的余数，所以不存在一个整数使用%对浮点数取余数，系统编译不过。要计算一个整数对浮点数取余数，可以使用fmod函数，代码如下，

#include

#include

//输出4对03取余的结果

int

main(int

argc,

char

argv[])

{

printf("%d\n",7%1/2);//由于%和/优先级相同,从左向右执行，7%1为0，0/2为0

printf("%lf\n",fmod(4,03));//输出0100000

return

0;

}

double

fmod(

double

x,

double

y

);函数返回参数x/y的余数，需要添加mathh头文件。

首先在程序需要中对INT型变量/代表取整运行，注意区分它们的不同，而%只能用于整数，取余运算 5%13=5，5除以13商0余5。

java取余运算：

取余（或余数）运算符用 number1 除以 number2 （把浮点数四舍五入为整数），然后只返回余数作为 result。

通常取模运算也叫取余运算，他们都遵循处罚法则，返回结果都是余数；

Java中取余运算具有如下性质：对所有int数值a和所有非零int数值b满足：(a / b ) b + (a % b) == a;

这意味着当取余 *** 作返回一个非零的结果时。它与左 *** 作数具有相同的正负符号。

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