怎么用vivado生成bin或者mcs文件

vivado生成bin: generate bitstream setting 勾选里面bin文件产生选项

vivado生成MCS:

使用TCL命令如下：

write_cfgmem -format mcs -interface bpix16 -size 128 -loadbit "up 0x0 FPGA_TOPbit" -file FPGA_TOPmcs

-fromat mcs 指定生成格式

-interface bpix16 指定Flash接口是BPI-x16

-size 128 指定Flash大小，这里是以Byte为单位

-loadbit “up 0x0 FPGA_TOPbit” 指定生成MCS的源文件以及写入Flash的地址位置

-file FPGA_TOPmcs 指定生成MCS的文件名称

两张方法：

1）从vivado的ipcore catalog里面直接拖出来。这个一般需要你用axi4总线去控制，所以你还需要axi4 interconnect，bram controller之类的ipcore。

2) 直接将ipcore catalog里面的bram添加到你的project模块中。可以选择不用axi4接口。这样你在模块里面声明实例化调用bram模块就行。

win11可以运行vivado。

Vivado是一款可供免费下载的工具，可提供与Vivado设计套件设计版本相同的以IP和系统为中心的设计流程。Vivado2019WebPACK中集成了所需证书，用户不用再手动添加证书文件，安装完成即可使用。

Vivado设计套件，是FPGA厂商赛灵思公司2012年发布的集成设计环境。包括高度集成的设计环境和新一代从系统到IC级的工具，这些均建立在共享的可扩展数据模型和通用调试环境基础上。这也是一个基于AMBAAXI4互联规范、IP封装元数据、工具命令语言、Synopsys系统约束SDC以及其它有助于根据客户需求量身定制设计流程并符合业界标准的开放式环境。

FPGA设计的CPU可以通过将benchmark程序编译为FPGA可执行代码来运行benchmark，有不同的工具可以做到这一点，例如Vivado HLS、Xilinx SDSoC等。

1、数字电路基础。做FPGA一定要有数字硬件的概念。FPGA是硬件设计，而不是软件设计，首先要有这个概念

2、硬件描述语言，Verilog或VHDL，推荐Verilog

3、主流厂家的芯片底层结构，如LogicCell、DSPBlock、时钟、IO单元等

4、EDA工具的使用，如主流厂家的集成编译环境（QuartusII、Vivado等）、仿真软件（ModelSim等）的使用

5、熟悉FPGA设计流程（仿真，综合，布局布线，时序分析）。

6、熟练掌握资源估算（特别是slice,lut,ram等资源的估算）。

7、同步设计原理。

一个合格的FPGA工程师至少在以下三个方面的一个非常熟悉：？

嵌入式应用？2DSP应用？3高速收发器应用

扩展资料

FPGA工程师的核心竞争力

1、RTL设计实现能力。也就是算法实现能力，RTL实现是FPGA工程师或者说HDL开发人员的入门首先接触到的东西；

2、硬件调试能力。包括问题定位分析能力和系统调试能力，FPGA工程师真正的核心竞争力，因为这不仅仅需要经验的积累，同时还需要很好的逻辑思维和分析能力。

另外一方面是整个硬件软件系统层次的调试能力，要看得懂原理图PCB，懂硬件，了解软件接口，现在FPGA越来越讲究-design，软件硬件这个系统层次的调试能力对人的要求更加高。

3、更加高层次的能力。还是系统层次的东西。算法和架构，怎样将一系列数学公式，转换为算法，在最终形成系统硬件的实现；

整个系统采用什么样的架构，纯FPGA，armFPGA，DSPFPGA，SOCFPGA；FPGA顶层采用什么架构，通用总线还是自定义总线，如何考虑通用性和可扩展性等等，再大至什么样的应用适合用FPGA实现。

什么样的问题适合软件实现，怎样的组合能更加低成本高效率的解决问题，这一些列问题涉及的东西有很多，基本上都是以FPGA为核心做开发要面临的问题，其实其他平台的硬件、软件产品都是类似，系统层面的问题都是复杂的问题，同时，从系统层面去优化，解决问题才是最高效率的方式。

FPGA是一种可编程逻辑设备，可以被用于实现各种电子电路。要从零设计一颗简单的FPGA芯片，需要经过以下步骤：

确定需求：首先，需要确定FPGA芯片需要实现什么功能。这将有助于确定芯片的规格，包括芯片大小、输入/输出接口和逻辑资源数量等。

选择开发工具：选择一种FPGA开发工具，例如Xilinx Vivado或Altera Quartus，以便开始设计。

设计原理图：使用开发工具，设计FPGA芯片的原理图。原理图是一种图形化表示电路的方式，其中包含连接元件的线和元件的符号。

编写HDL代码：HDL是硬件描述语言，类似于软件编程语言，可以用于描述电路行为。使用HDL编写代码来实现芯片的逻辑功能。

模拟和验证：使用开发工具提供的仿真工具来验证设计的正确性。这可以帮助检查逻辑是否正确，并找出任何问题。

约束设计：设计约束是一种方法，可将设计约束到可靠的时序，电气和物理要求。它还可以确保电路实现的高性能和可靠性。

实现设计：一旦确认设计的正确性，将HDL代码合成为FPGA的bit流。这个过程可以将代码翻译成FPGA可以理解的语言。

下载并验证：最后，将bit流下载到FPGA芯片中，验证设计是否按预期工作。

需要注意的是，FPGA设计是一项复杂的任务，需要深入了解电路设计和计算机科学的基础知识。此外，需要掌握FPGA开发工具的使用方法。

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