请问FPGA综合Verilog代码后下载到flash中就可以运行了，为何要布线

布线的意思是信号的路径，FPGA是有“面积”和“速度”的概念的，路径有好坏，占用资源有多少，一样的代码在不同的片子中综合出来的电路可能就是不一样的了，有优劣之分，所以，建议为代码添加一定的约束条件，让电路更好。

据说高手对器件很熟悉的话，一边写一边可以在脑子里有电路架构模型，这个我本人还没有到那个程度。

修正一下FPGA的启动（我接触的）是EEPROM引导，好像不是你说的FLASH吧。上电时,FPGA输出一个CLK给程序存储器，串行方式或并行方式将程序引导入FPGA自身程序存储器，加载完成后启动运行。

FPGA和其他编程不一样的是，他的编程是硬件语言，实际上就像是PCB制图一样调用元器件画线，最终在FPGA器件中是用最底层的元实现的数字电路。

你选的是quad spi flash ，应该使用并行的nor flash吧，不然就可以直接用spi配置fpga了，

不需要cpld，需要并行flash的目的就是配置速度。

你看我的图

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