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  cortex-a9是什么处理器

  Cortex-A9 是十年前性能最高的ARM处理器,可实现受到广泛支持的 ARMv7 体系结构的丰富功能。Cortex-A9 处理器的设计旨在打造最先进的、高效率的、长度动态可变的、多指令执行超标量体系结构,提供采用乱序猜测方式执行的 8 阶段管道处理器,凭借范围广泛的消费类、网络、企业和移动应用中的前沿产品所需的功能,它可以提供史无前例的高性能和高能效。

  ARM处理器简介

  ARM(Advanced RISC Machines)一个32位元精简指令集(RISC)处理器架构,ARM处理器广泛地使用在许多嵌入式系统设计。ARM处理器的特点有指令长度固定,执行效率高,低成本等。

  ARM处理特点

  1、体积小、低功耗、低成本、高性能;

  2、支持Thumb(16位)/ARM(32位)双指令集,能很好的兼容8位/16位器件;

  3、大量使用寄存器,指令执行速度更快;

  4、大多数数据 *** 作都在寄存器中完成;

  5、寻址方式灵活简单,执行效率高;

  6、指令长度固定。

  

  cortex-a9处理器介绍

  Cortex-A9 微体系结构既可用于可伸缩的多核处理器(Cortex-A9 MPCore™ 多核处理器),也可用于更传统的处理器(Cortex-A9 单核处理器)。

  Cortex-A9微架构可提供两种选项:可扩展的Cortex-A9 MPCoreTM多核处理器和较为传统的Cortex-A9单核处理器。可扩展的多核处理器和单核处理器,支持16、32或64KB四路组相联一级缓存的配置,具有无与伦比的灵活性,皆能达到特定应用和市场的要求。

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  Cortex-A9单核处理器

  Cortex-A9处理器拥有首屈一指的性能和功效,对于要求高性能的低功耗、成本敏感、基于单核处理器的设备,它无疑是理想的解决方案。现有ARM11TM处理器级设计不仅要求在不增加硅成本及功耗的前提下提升性能和功效,同时还要求维持一个高度兼容的软件环境,因此,Cortex-A9处理器采用了一种便利的可综合IP交付,为现有的ARM11TM提供了理想的升级通道。

  Cortex-A9单核处理器为独立指令和数据传输提供两个低延时Harvard64-bitAMBA 3AXITM Master接口,在通过内存缓存区复制数据时,每五个处理器周期能维持四次双字写入。

  Cortex-A9多核处理器

  Cortex-A9多核处理器集成了经验证非常成功的 ARM MPCore 技术以及更多增强功能,以此简化了多核解决方案,并使其应用范围得到扩展。Cortex-A9 MPCore 处理器可提供史无前例的可扩展的最高性能,同时还支持灵活设计和新功能,从而进一步降低和控制处理器和系统级的能耗。借助 Cortex-A9 MPCore 处理器的定向实现,移动设备的最高性能还可在现在的解决方案的基础上不断提高,具体方法是:利用设计灵活性和 ARM MPCore 技术提供的高级功率管理技术,在散热受限以及移动电源预算紧张的情况下维持运行。使用可伸缩的最高性能,该处理器可超过现今类似的高性能嵌入式设备的性能,并可在拓宽市场的基础上进行稳定的软件投资。

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  Cortex-A9多核处理器的特点及优势

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  cortex-a9处理器的硬宏实现

  除了单核和多核软宏外,常用的双核配置也可用作 TSMC 40G/GL 工艺的硬宏实现,从而最大程度地缩短高性能 Cortex-A9 处理器的上市时间,降低与其上市关联的风险和成本。利用优化的 ARM 物理 IP 和先进的实现技术,该硬宏可用作功率优化实现或性能优化实现

  速度优化

  速度优化硬宏实现可向系统设计人员提供行业标准 ARM 处理器的整合低功率技术,从而使 ARM 的性能领先优势进一步延伸到紧凑、高密度和散热受限的环境所需的功率包络中的高利润消费类设备和企业设备。从标准硅中选择该硬宏实现后,它的运行频率超过 2GHz,代表了面向性能的高利润应用中的理想解决方案。

  功率优化

  在许多散热受限的应用领域(如机顶盒、DTV、打印机和其他功能丰富的消费类应用和高密度的企业应用)中,能效极为重要。从标准硅中选择 Cortex-A9 功率优化硬宏实现后,其提供的最高性能达到 4000 DMIPS,而每个 CPU 的能耗不到 250mW。

  该硬宏实现包括符合 ARM AMBA 标准的高性能系统组件,可以最大程度地提高数据通信速度,同时使能耗和硅面积降到最低。各 Cortex-A9 硬宏实现还包括 CoreSight™ 程序跟踪宏单元 (PTM),它使处理器的指令流完全可见,从而使软件社区成员能够开发优化性能的代码。此外,该宏还包括 ARM 高性能 L2 高速缓存控制器,它支持 L2 高速缓存内存介于 128K 和 8M 之间的配置。

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