EDA的数字钟设计
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YOU的
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程序都有的
立创EDA支持导出原理图,PCB,库文件的立创EDA文件到本地。
1、直接导出立创EDA文件
通过 顶部菜单 > 文件 > 立创EDA文件… 打开立创EDA文件源码,点击下载即可。
2、下载整个工程
可通过: 左侧工程列表 - 工程文件夹 - 右键 - 下载。你将下载整个工程的设计文件为一个 ZIP 压缩包,解压后为 JSON 后缀的立创EDA源码文件。
也可以通过:左侧工程列表 - 工程文件夹 - 右键 - 备份工程。
会在新开网页打开一个对话框,选择需要备份的工程后进行备份,每天只能备份一次。
立创EDA文件是一个JSON文件,该文件类型可以被其他程序打开和编辑。 关于Json的介绍请查看:Jsoncn: 什么是Json;Json官网: Json介绍
3、打开立创EDA文件
当你保存了立创EDA文件到本地后,想再次打开,可通过:顶部菜单 - 文件 - 打开 - 立创EDA…。
eda编程9人表决器程序详解://本程序用VERILOG HDL语言实现,描述9人表决器。
module biaojueqi(vote,ledr,ledg,dis_out)
input [8:0] vote
reg [6:0] dis_out;
integer i,sum; //sum表示赞同的人数
for(i=0;i<=8;i=i+1)
if(vote[i]) sum<=sum+1;
end
always @(sum) //结果由dis_out显示在数码管上
case (sum)
0: dis_out[6:0]<=7'b1111110;
1: dis_out[6:0]<=7'b0110000;
2: dis_out[6:0]<=7'b1101101;
3: dis_out[6:0]<=7'b1111001;
4: dis_out[6:0]<=7'b0110011;
5: dis_out[6:0]<=7'b1011011;
6: dis_out[6:0]<=7'b1011111;
7: dis_out[6:0]<=7'b1110000;
8: dis_out[6:0]<=7'b1111111;
9: dis_out[6:0]<=7'b1111011;
endmodule
内容简介
本书从实际应用的角度出发,全面系统地介绍了EDA技术和硬件描述语言VHDL,将VHDL的基础知识、编程技巧、实用方法与实际工程开发技术在EDA软件设计平台上很好地结合起来,使读者能够通过本书的学习迅速了解并掌握EDA技术的基本理论和工程开发实用技术。
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