锁相环PLL电路原理及笔记本主板PLL芯片汇总

　　锁相环 （phase locked loop），顾名思义，就是锁定相位的环路。学过自动控制原理的人都知道，这是一种典型的反馈控制电路，利用外部输入的参考信号控制环路内部振荡信号的频率和相位，实现输出信号频率对输入信号频率的自动跟踪，一般用于闭环跟踪电路。是无线电发射中使频率较为稳定的一种方法，主要有VCO（压控振荡器）和PLL IC （锁相环集成电路），压控振荡器给出一个信号，一部分作为输出，另一部分通过分频与PLL IC所产生的本振信号作相位比较，为了保持频率不变，就要求相位差不发生改变，如果有相位差的变化，则PLL IC的电压输出端的电压发生变化，去控制VCO，直到相位差恢复，达到锁相的目的。能使受控振荡器的频率和相位均与输入信号保持确定关系的闭环电子电路。

　　PLL（锁相环）电路原理

　　在通信机等所使用的振荡电路，其所要求的频率范围要广，且频率的稳定度要高。无论多好的LC振荡电路，其频率的稳定度，都无法与晶体振荡电路比较。但是，晶体振荡器除了可以使用数字电路分频以外，其频率几乎无法改变。如果采用PLL（锁相环）（相位锁栓回路，PhaseLockedLoop）技术，除了可以得到较广的振荡频率范围以外，其频率的稳定度也很高。此一技术常使用于收音机，电视机的调谐电路上，以及CD唱盘上的电路。

　　PLL（锁相环）电路的基本构成 　　PLL（锁相环）电路的概要

　　图1所示的为PLL（锁相环）电路的基本方块图。此所使用的基准信号为稳定度很高的晶体振荡电路信号。

　　此一电路的中心为相位此较器。相位比较器可以将基准信号与VCO （Voltage Controlled Oscillator……电压控制振荡器）的相位比较。如果此两个信号之间有相位差存在时，便会产生相位误差信号输出。

　　

　　（将VCO的振荡频率与基准频率比较，利用反馈电路的控制，使两者的频率为一致。）

　　利用此一误差信号，可以控制VCO的振荡频率，使VCO的相位与基准信号的相位（也即是频率）成为一致。

　　PLL（锁相环）可以使高频率振荡器的频率与基准频率的整数倍的频率相一致。由于，基准振荡器大多为使用晶体振荡器，因此，高频率振荡器的频率稳定度可以与晶体振荡器相比美。

　　只要是基准频率的整数倍，便可以得到各种频率的输出。

　　从图1的PLL（锁相环）基本构成中，可以知道其是由VCO，相位比较器，基准频率振荡器，回路滤波器所构成。在此，假设基准振荡器的频率为fr，VCO的频率为fo。

　　在此一电路中，假设fr》fo时，也即是VC0的振荡频率fo比fr低时。此时的相位比较器的输出PD会如图2所示，产生正脉波信号，使VCO的振荡器频率提高。相反地，如果fr《fo时，会产生负脉波信号。

　　

　　（此为利用脉波的边缘做二个信号的比较。如果有相位差存在时，便会产生正或负的脉波输出。）

　　此一PD脉波信号经过回路滤波器（LoopFilter）的积分，便可以得到直流电压VR，可以控制VCO电路。

　　由于控制电压vr的变化，VCO振荡频率会提高。结果使得fr=f。在f与f的相位成为一致时，PD端子会成为高阻抗状态，使PLL（锁相环）被锁栓（Lock）。