Modelsim使用教程

1、File——New——Project——设置工程名和路径——点击OK

2、点击Create New File——设置文件名——Add file as type设置为Verilog——点击OK

4、双击两个文件进行编辑

8、点击上图中（类似书本）Run-All按钮，则开始进行仿真，得到仿真波形如上图所示。

Break仿真原波形——选择左下方的Projects，双击文件进行修改保存——编译（可以选择只编译修改的文件）——选择Simulate选项里的Restart，点击Run-All——得到修改后的仿真波形

modelsim Mentor公司的ModelSim是业界最优秀的HDL语言仿真软件，它能提供友好的仿真环境，是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术，编译仿真速度快，编译的代码与平台无关，便于保护IP核，个性化的图形界面和用户接口，为用户加快调错提供强有力的手段，是FPGA/ASIC设计的首选仿真软件。 主要特点： • RTL和门级优化，本地编译结构，编译仿真速度快，跨平台跨版本仿真； • 单内核VHDL和Verilog混合仿真； • 源代码模版和助手，项目管理； • 集成了性能分析、波形比较、代码覆盖、数据流ChaseX、Signal Spy、虚拟对象Virtual Object、Memory窗口、Assertion窗口、源码窗口显示信号值、信号条件断点等众多调试功能； • C和Tcl/Tk接口，C调试； • 对SystemC的直接支持，和HDL任意混合 • 支持SystemVerilog的设计功能； • 对系统级描述语言的最全面支持，SystemVerilog, SystemC, PSL • ASIC Sign off。 ModelSim分几种不同的版本：SE、PE、LE和OEM，其中SE是最高级的版本,而集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA厂商设计工具中的均是其OEM版本。SE版和OEM版在功能和性能方面有较大差别，比如对于大家都关心的仿真速度问题，以Xilinx公司提供的OEM版本ModelSim XE为例，对于代码少于40000行的设计，ModelSim SE 比ModelSim XE要快10倍；对于代码超过40000行的设计，ModelSim SE要比ModelSim XE快近40倍。ModelSim SE支持PC、UNIX和LINUX混合平台；提供全面完善以及高性能的验证功能；全面支持业界广泛的标准；Mentor Graphics公司提供业界最好的技术支持与服务。

有没有告诉你路径不符？如果是，请在tools -->option里面设置modelsim路径 指向modelsim安装路径里的modelsim_ase-->win32aloem文件夹即可

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