用3线8线译码器74LS138和与非门设计三人表决器。

用3线8线译码器74LS138和与非门设计三人表决器。,第1张

与非门用74LS20,四输入与非门。

0表示否定。

011

101

110

111四种情况表决通过。。

A

B

C代表3个人,然后简化1表示赞成

扩展资料:

用一块3线-8线译码器74LS138可以组成任何一个三变量输入的逻辑函数,任意一个输入三变量的逻辑函数都可以用一块3线-8线译码器74LS138来实现。因为任意一个组合逻辑表达式都可以写成标准与或式的形式,即最小项之和的形式,而·块3线-8线译码器74LS138的输出正好是二变量最小项的全部体现。

参考资料来源:百度百科-74LS138

有16个 我假设你的四变量为abcd,那么译码输出信号为OUT0~OUT15 对应关系如下 输入端 输出端 abcd OUT0~OUT15 0000 1000,0000,0000,0000 0001 0100,0000,0000,0000 0010 0010,0000,0000,0000 0011 0001,0000,0000,0000 0100 0000,1000,0000,0000 0101 0000,0100,0000,0000 0110 0000,0010,0000,0000 0111 0000,0001,0000,0000 1000 0000,0000,1000,0000 1001 0000,0000,0100,0000 1010 0000,0000,0010,0000 1011 0000,0000,0001,0000 1100 0000,0000,0000,1000 1101 0000,0000,0000,0100 1110 0000,0000,0000,0010 1111 0000,0000,0000,0001

用74LS138译码器设计三人表决电路仿真图如下。

用4选一数据选择器74LS153设计的三人表决电路仿真图如下。

请及时采纳!

首先得弄清楚全加器的原理,你这里说的应该是设计1位的全加器

全加器有3个输入端:a,b,ci;有2个输出端:s,co

与3-8译码器比较,3-8译码器有3个数据输入端:A,B,C;3个使能端;8个输出端,OUT(0-7)

这里可以把3-8译码器的3个数据输入端当做全加器的3个输入端,即3-8译码器的输入A、B、C分别对应全加器的输入a,b,ci;将3-8译码器的3个使能端都置为有效电平,保持正常工作;这里关键的就是处理3-8译码的8个输出端与全加器的2个输出的关系

现在写出全加器和3-8译码器的综合真值表:

(A/a,B/b,C/ci为全加器和译码器的输入,OUT为译码器的输出(0-7),s为加法器的和,co为加法器的进位输出)PS:假定译码器的输出为高电平有效

A/a B/b C/ci OUT s co

0 0 0 0 0 0

0 0 1 1 1 0

0 1 0 2 1 0

0 1 1 3 0 1

1 0 0 4 1 0

1 0 1 5 0 1

1 1 0 6 0 1

1 1 1 7 1 1

根据上面的真值表,可以设计出电路图:

将3-8译码器的输出OUT(1、2、4、7)作为一个4输入的或门的输入,或门的输出作为加法器的和;将3-8译码器的输出OUT(3、5、6、7)作为一个4输入的或门的输入,或门的输出作为加法器的进位输出即完成了加法器的设计

回过头来分析:

当加法器的输入分别为:a=1,b=0,ci=1时,对应3-8译码器的输入为A=1,B=0,C=1,这是译码器对应的输出为OUT(5)=1,其余的为0,根据上面设计的连接关系,s=0,co=1,满足全加器的功能,举其他的例子也一样,所以,设计全加器的设计正确

1、当一个选通端(E1)为高电平,另两个选通端为低电平时,可将地址端(A0、A1、A2)的二进制编码在Y0至Y7对应的输出端以低电平译出。(即输出为Y0至Y7的非)比如:A2A1A0=110时,则Y6输出端输出低电平信号。

2、利用 E1、E2和E3可级联扩展成24线译码器;若外接一个反相器还可级联扩展成32线译码器。

3、若将选通端中的一个作为数据输入端时,74LS138还可作数据分配器。

4、可用在8086的译码电路中,扩展内存。

扩展资料

一个现代译码器的主要工作流程:源代码 (source code) →预处理器 (preprocessor) →编译器 (compiler) →目标代码 (object code) →链接器 (Linker) →可执行程序 (executables)。

高级计算机语言便于人编写,阅读交流,维护。机器语言为计算机能直接解读、运行的。

译码器将汇编或高级计算机语言源程序(Source program)作为输入,翻译成目标语言(Target language)机器代码的等价程序。

源代码一般为高级语言 (High-level language), 如Pascal、C、C++、Java、汉语编程等或汇编语言,而目标则是机器语言的目标代码(Object code),有时也称作机器代码(Machine code)。

对于C#、VB等高级语言而言,此时编译器完成的功能是把源码(SourceCode)编译成通用中间语言(MSIL/CIL)的字节码(ByteCode)。

最后运行的时候通过通用语言运行库的转换,编程最终可以被CPU直接计算的机器码(NativeCode)。

参考资料来源:百度百科-编译器

参考资料来源:百度百科-74LS138

以上就是关于用3线8线译码器74LS138和与非门设计三人表决器。全部的内容,包括:用3线8线译码器74LS138和与非门设计三人表决器。、38译码器实现三变量表决电路,当输入为两个或两个以上为1时,输出为1,其他输入时,输出为0、用两种方法设计组合逻辑电路,实现3人表决的功能,要求分别用38译码器和4选一。等相关内容解答,如果想了解更多相关内容,可以关注我们,你们的支持是我们更新的动力!

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原文地址: http://outofmemory.cn/zz/10169858.html

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