verilog中assign{ }是什么意思

我感觉吧，cout表示ina+inb+cin的最高那位，sum表示ina+inb+cin的低四位

assign的含义是定义，{cout,sum}这个的含义是将括号内的数按位并在一起，比如：{1001,1110}表示的是10011110

assign还有个相似的用法如：assign A = {a，b}；

若a = 100101，b = 1010

那么A就被定义成了A = 1001011010；

整个语句：assign {cout,sum}=ina+inb+cin;

含义为将四位数ina，inb，cin相加，其值放入sum，进位放入cout。恩，这是一个带进位的加法模块。cin表示的是上一级加法给这一级的进位。

希望对你有所帮助。

要还是不懂可百度hi我

如果要用自己写的这两个程序建立全加器，还要写一个主程序用component调用这两个程序而且要用port map 语句把进出的管脚连线说明白，之后用这三个程序建工程 也可以 先写half_adder,编译通过之后点file->create/update->create symbol file for current file,变成符号元件存盘之后，之后新建原理图文件(file->new->block diagram/schematic file)调用元件库中的or2和half_adder,连线保存，以这个文件建立工程编译，应该能行，或者写两个vhdl文件，half_adder和full_adder，full_adder中用component调用half_adder,用这两个文件建工程然后编译

全加器的输出有三个逻辑变量。根据查询相关资料显示，全加器的输出采用组合逻辑门设计，一个三变量表决器，一个真值表，一个电路连接图。芯片上可以灵活的编制自己需要的程序来制作。具体可以咨询相关工作人员了解。

若是运行或者下载第三方软件时出现此提示，建议卸载该软件后重新安装尝试。 *** 作：设定-应用程序管理器-已下载，查找软件并卸载。

2设定-应用程序管理器-全部-点击左下角菜单键-重置应用程序偏好。

3若是某个软件出现此情况，建议再次进入应用程序管理器-全部-查找该软件-清除数据（注：应用程序的全部数据将被永久性删除）。

4如果运行内置程序也会出现此情况，若您的手机支持在线升级，请进入设定-关于设备（关于手机）-软件更新（系统更新）-更新（升级前请备份手机中数据）。

5若无效，请备份手机中数据，然后恢复出厂设置（设定--重置/隐私权/个人--恢复出厂设置）。若问题依然存在，就直接送修吧。至于下载的软件无法安装，可以在设置--安全--未知来源，勾选上就可以了。另外，如果不是apk格式的文件，也是无法安装的。

一位全加器源代码如下：

library ieee;

use ieeestd_logic_1164all;

use ieeestd_logic_unsignedall;

use ieeestd_logic_arithall;

entity bit1adder is

port(

a,b,ci:in std_logic;

s,co:out std_logic

);

end bit1adder;

architecture func of bit1adder is --此功能可由真值表推出，或者亦可直接列出真值表代替此程序

signal:x,y:std_logic;

begin

x<=a xor b;

y<=x and ci;

s<=x xor ci;

co<=y or (a and b);

end func;

＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝＝

二位全加器源代码如下：

library ieee;

use ieeestd_logic_1164all;

use ieeestd_logic_unsignedall;

use ieeestd_logic_arithall; --此包含有类型转换函数

entity bit2adder is

port(

a,b:in std_logic_vector(1 downto 0);

ci:in std_logic;

co:out std_logic;

s:out std_logic_vector(1 downto 0)

);

end bit2adder;

architecture func of bit2adder is

begin

process(a,b,ci) --更多位的也可按照此思路来写

variable temp:std_logic_vector(2 downto 0);

variable x,y,sum:ingeter;

begin

x:=conv_integer(a);

y:=conv_integer(b);

sum:=(x+y)+conv_integer(ci);

temp:=conv_std_logic_vector(sum,3);

s<=temp(1 downto 0);

co<=temp(2);

end process;

end func;

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